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文件名称:Computer-Architecture-lab6

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [PDF]
  • 上传时间：
    2012-11-16
  • 文件大小：
    4.08mb
  • 已下载：
    0次
  • 提 供 者：
    聪***
  • 相关连接：
    无
  • 下载说明：
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介绍说明－－下载内容来自于网络，使用问题请自行百度

计算机组成实验作业6，fpga开发板，verilog语言编写-Composition of experimental computer operating 6, fpga development board, verilog language
(系统自动生成,下载前可以参看下载内容)

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09级计组实验_B班_31组_5090309744_谢聪_实验6代码/aluctr.v
09级计组实验_B班_31组_5090309744_谢聪_实验6代码/ALU_summary.html
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09级计组实验_B班_31组_5090309744_谢聪_实验6代码/datafile.coe
09级计组实验_B班_31组_5090309744_谢聪_实验6代码/datamemory.mif
09级计组实验_B班_31组_5090309744_谢聪_实验6代码/dmemory.mif
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09级计组实验_B班_31组_5090309744_谢聪_实验6代码/ipcore_dir/datamemory.ise
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