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文件名称:VHDL

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
  • 上传时间：
    2012-11-16
  • 文件大小：
    17.45kb
  • 已下载：
    0次
  • 提 供 者：
    man****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

It s a simple calculator of addition and multiplication using a simple stack, with multiple test benches.

The files test-button and debounce are for the use on a board for the correct functionality of the input buttons.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

VHDL/adder15.vhd
VHDL/arith.vhd
VHDL/base2tobase16.vhd
VHDL/Count.vhd
VHDL/debounce.vhd
VHDL/display_control.vhd
VHDL/fulladd.vhd
VHDL/memory.vhd
VHDL/reg.vhd
VHDL/shiftRegister.vhd
VHDL/stack.vhd
VHDL/stack_FSM.vhd
VHDL/test-button.vhd
VHDL/test1.vhd
VHDL/test2.vhd
VHDL/testMult.vhd
VHDL/top_stack.vhd
VHDL

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