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文件名称:the-design-of-string-out-of-register

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
  • 上传时间：
    2012-11-16
  • 文件大小：
    304.06kb
  • 已下载：
    0次
  • 提 供 者：
    初***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

利用FPGA编程-------实现“并入串出寄存器设计”-Use of FPGA programming-------incorporated into the design of string out of register
(系统自动生成,下载前可以参看下载内容)

下载文件列表

实验5 并入串出寄存器设计/add4.asm.rpt
实验5 并入串出寄存器设计/add4.done
实验5 并入串出寄存器设计/add4.fit.rpt
实验5 并入串出寄存器设计/add4.fit.smsg
实验5 并入串出寄存器设计/add4.fit.summary
实验5 并入串出寄存器设计/add4.flow.rpt
实验5 并入串出寄存器设计/add4.map.rpt
实验5 并入串出寄存器设计/add4.map.summary
实验5 并入串出寄存器设计/add4.pin
实验5 并入串出寄存器设计/add4.pof
实验5 并入串出寄存器设计/add4.qpf
实验5 并入串出寄存器设计/add4.qsf
实验5 并入串出寄存器设计/add4.qws
实验5 并入串出寄存器设计/add4.sim.rpt
实验5 并入串出寄存器设计/add4.sof
实验5 并入串出寄存器设计/add4.tan.rpt
实验5 并入串出寄存器设计/add4.tan.summary
实验5 并入串出寄存器设计/add4.vhd
实验5 并入串出寄存器设计/add4.vhd.bak
实验5 并入串出寄存器设计/add4.vwf
实验5 并入串出寄存器设计/db/add4.(0).cnf.cdb
实验5 并入串出寄存器设计/db/add4.(0).cnf.hdb
实验5 并入串出寄存器设计/db/add4.asm.qmsg
实验5 并入串出寄存器设计/db/add4.asm_labs.ddb
实验5 并入串出寄存器设计/db/add4.cbx.xml
实验5 并入串出寄存器设计/db/add4.cmp.bpm
实验5 并入串出寄存器设计/db/add4.cmp.cdb
实验5 并入串出寄存器设计/db/add4.cmp.ecobp
实验5 并入串出寄存器设计/db/add4.cmp.hdb
实验5 并入串出寄存器设计/db/add4.cmp.logdb
实验5 并入串出寄存器设计/db/add4.cmp.rdb
实验5 并入串出寄存器设计/db/add4.cmp.tdb
实验5 并入串出寄存器设计/db/add4.cmp0.ddb
实验5 并入串出寄存器设计/db/add4.cmp_bb.cdb
实验5 并入串出寄存器设计/db/add4.cmp_bb.hdb
实验5 并入串出寄存器设计/db/add4.cmp_bb.logdb
实验5 并入串出寄存器设计/db/add4.cmp_bb.rcf
实验5 并入串出寄存器设计/db/add4.dbp
实验5 并入串出寄存器设计/db/add4.db_info
实验5 并入串出寄存器设计/db/add4.eco.cdb
实验5 并入串出寄存器设计/db/add4.eds_overflow
实验5 并入串出寄存器设计/db/add4.fit.qmsg
实验5 并入串出寄存器设计/db/add4.fnsim.cdb
实验5 并入串出寄存器设计/db/add4.fnsim.hdb
实验5 并入串出寄存器设计/db/add4.fnsim.qmsg
实验5 并入串出寄存器设计/db/add4.hier_info
实验5 并入串出寄存器设计/db/add4.hif
实验5 并入串出寄存器设计/db/add4.map.bpm
实验5 并入串出寄存器设计/db/add4.map.cdb
实验5 并入串出寄存器设计/db/add4.map.ecobp
实验5 并入串出寄存器设计/db/add4.map.hdb
实验5 并入串出寄存器设计/db/add4.map.logdb
实验5 并入串出寄存器设计/db/add4.map.qmsg
实验5 并入串出寄存器设计/db/add4.map_bb.cdb
实验5 并入串出寄存器设计/db/add4.map_bb.hdb
实验5 并入串出寄存器设计/db/add4.map_bb.logdb
实验5 并入串出寄存器设计/db/add4.pre_map.cdb
实验5 并入串出寄存器设计/db/add4.pre_map.hdb
实验5 并入串出寄存器设计/db/add4.psp
实验5 并入串出寄存器设计/db/add4.pss
实验5 并入串出寄存器设计/db/add4.rtlv.hdb
实验5 并入串出寄存器设计/db/add4.rtlv_sg.cdb
实验5 并入串出寄存器设计/db/add4.rtlv_sg_swap.cdb
实验5 并入串出寄存器设计/db/add4.sgdiff.cdb
实验5 并入串出寄存器设计/db/add4.sgdiff.hdb
实验5 并入串出寄存器设计/db/add4.signalprobe.cdb
实验5 并入串出寄存器设计/db/add4.sim.cvwf
实验5 并入串出寄存器设计/db/add4.sim.hdb
实验5 并入串出寄存器设计/db/add4.sim.qmsg
实验5 并入串出寄存器设计/db/add4.sim.rdb
实验5 并入串出寄存器设计/db/add4.simfam
实验5 并入串出寄存器设计/db/add4.sld_design_entry.sci
实验5 并入串出寄存器设计/db/add4.sld_design_entry_dsc.sci
实验5 并入串出寄存器设计/db/add4.syn_hier_info
实验5 并入串出寄存器设计/db/add4.tan.qmsg
实验5 并入串出寄存器设计/db/add4.tis_db_list.ddb
实验5 并入串出寄存器设计/db/mux_lpc.tdf
实验5 并入串出寄存器设计/db/prev_cmp_add4.map.qmsg
实验5 并入串出寄存器设计/db/prev_cmp_add4.qmsg
实验5 并入串出寄存器设计/db/prev_cmp_add4.sim.qmsg
实验5 并入串出寄存器设计/db/wed.wsf
实验5 并入串出寄存器设计/db
实验5 并入串出寄存器设计

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