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文件名称:jiafaqi

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [HTML]
  • 上传时间：
    2012-11-16
  • 文件大小：
    438.1kb
  • 已下载：
    0次
  • 提 供 者：
    卢****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

利用FPGA，VHDL设计一个加法器控制LED。-The use of FPGA, VHDL design an adder control LED.
(系统自动生成,下载前可以参看下载内容)

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11实验十一：加法器数码管显示/
11实验十一：加法器数码管显示/add.asm.rpt
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11实验十一：加法器数码管显示/db/add.lpc.html
11实验十一：加法器数码管显示/db/add.lpc.rdb
11实验十一：加法器数码管显示/db/add.lpc.txt
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11实验十一：加法器数码管显示/db/prev_cmp_sub.asm.qmsg
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11实验十一：加法器数码管显示/db/prev_cmp_sub.tan.qmsg
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11实验十一：加法器数码管显示/db/sub.cmp.cdb
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11实验十一：加法器数码管显示/db/sub.cmp.kpt
11实验十一：加法器数码管显示/db/sub.cmp.logdb
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11实验十一：加法器数码管显示/db/sub.hier_info
11实验十一：加法器数码管显示/db/sub.hif
11实验十一：加法器数码管显示/db/sub.lpc.html
11实验十一：加法器数码管显示/db/sub.lpc.rdb
11实验十一：加法器数码管显示/db/sub.lpc.txt
11实验十一：加法器数码管显示/db/sub.map.cdb
11实验十一：加法器数码管显示/db/sub.map.hdb
11实验十一：加法器数码管显示/db/sub.map.logdb
11实验十一：加法器数码管显示/db/sub.map.qmsg
11实验十一：加法器数码管显示/db/sub.pre_map.cdb
11实验十一：加法器数码管显示/db/sub.pre_map.hdb
11实验十一：加法器数码管显示/db/sub.rtlv.hdb
11实验十一：加法器数码管显示/db/sub.rtlv_sg.cdb
11实验十一：加法器数码管显示/db/sub.rtlv_sg_swap.cdb
11实验十一：加法器数码管显示/db/sub.sgdiff.cdb
11实验十一：加法器数码管显示/db/sub.sgdiff.hdb
11实验十一：加法器数码管显示/db/sub.sld_design_entry.sci
11实验十一：加法器数码管显示/db/sub.sld_design_entry_dsc.sci
11实验十一：加法器数码管显示/db/sub.syn_hier_info
11实验十一：加法器数码管显示/db/sub.tan.qmsg
11实验十一：加法器数码管显示/db/sub.tis_db_list.ddb
11实验十一：加法器数码管显示/db/sub.tmw_info
11实验十一：加法器数码管显示/db/sub_cmp.qrpt
11实验十一：加法器数码管显示/incremental_db/
11实验十一：加法器数码管显示/incremental_db/README
11实验十一：加法器数码管显示/incremental_db/compiled_partitions/
11实验十一：加法器数码管显示/incremental_db/compiled_partitions/add.root_partition.map.kpt
11实验十一：加法器数码管显示/incremental_db/compiled_partitions/sub.root_partition.map.kpt
11实验十一：加法器数码管显示/transcript

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