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文件名称:ep1c12_29_dds

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
  • 上传时间：
    2012-11-30
  • 文件大小：
    483.19kb
  • 已下载：
    1次
  • 提 供 者：
    无*****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

DDS设计：该程序完成了在Quartus Ⅱ上使用VHDL语言实现的DDS波形调制设计-DDS Design: The procedure is completed in Quartus ii the DDS waveform modulation design using VHDL language
(系统自动生成,下载前可以参看下载内容)

下载文件列表

ep1c12_29_dds/cmp_state.ini
ep1c12_29_dds/db/altsyncram_5a31.tdf
ep1c12_29_dds/db/dds.(0).cnf.cdb
ep1c12_29_dds/db/dds.(0).cnf.hdb
ep1c12_29_dds/db/dds.(1).cnf.cdb
ep1c12_29_dds/db/dds.(1).cnf.hdb
ep1c12_29_dds/db/dds.(2).cnf.cdb
ep1c12_29_dds/db/dds.(2).cnf.hdb
ep1c12_29_dds/db/dds.(3).cnf.cdb
ep1c12_29_dds/db/dds.(3).cnf.hdb
ep1c12_29_dds/db/dds.(4).cnf.cdb
ep1c12_29_dds/db/dds.(4).cnf.hdb
ep1c12_29_dds/db/dds.(5).cnf.cdb
ep1c12_29_dds/db/dds.(5).cnf.hdb
ep1c12_29_dds/db/dds.(6).cnf.cdb
ep1c12_29_dds/db/dds.(6).cnf.hdb
ep1c12_29_dds/db/dds.(7).cnf.cdb
ep1c12_29_dds/db/dds.(7).cnf.hdb
ep1c12_29_dds/db/dds.asm.qmsg
ep1c12_29_dds/db/dds.cbx.xml
ep1c12_29_dds/db/dds.cmp.cdb
ep1c12_29_dds/db/dds.cmp.hdb
ep1c12_29_dds/db/dds.cmp.logdb
ep1c12_29_dds/db/dds.cmp.rdb
ep1c12_29_dds/db/dds.cmp.tdb
ep1c12_29_dds/db/dds.cmp0.ddb
ep1c12_29_dds/db/dds.dbp
ep1c12_29_dds/db/dds.db_info
ep1c12_29_dds/db/dds.eco.cdb
ep1c12_29_dds/db/dds.fit.qmsg
ep1c12_29_dds/db/dds.hier_info
ep1c12_29_dds/db/dds.hif
ep1c12_29_dds/db/dds.map.cdb
ep1c12_29_dds/db/dds.map.hdb
ep1c12_29_dds/db/dds.map.logdb
ep1c12_29_dds/db/dds.map.qmsg
ep1c12_29_dds/db/dds.pre_map.cdb
ep1c12_29_dds/db/dds.pre_map.hdb
ep1c12_29_dds/db/dds.psp
ep1c12_29_dds/db/dds.pss
ep1c12_29_dds/db/dds.rtlv.hdb
ep1c12_29_dds/db/dds.rtlv_sg.cdb
ep1c12_29_dds/db/dds.rtlv_sg_swap.cdb
ep1c12_29_dds/db/dds.sgdiff.cdb
ep1c12_29_dds/db/dds.sgdiff.hdb
ep1c12_29_dds/db/dds.signalprobe.cdb
ep1c12_29_dds/db/dds.sld_design_entry.sci
ep1c12_29_dds/db/dds.sld_design_entry_dsc.sci
ep1c12_29_dds/db/dds.syn_hier_info
ep1c12_29_dds/db/dds.tan.qmsg
ep1c12_29_dds/dds.asm.rpt
ep1c12_29_dds/dds.bsf
ep1c12_29_dds/dds.done
ep1c12_29_dds/dds.fit.eqn
ep1c12_29_dds/dds.fit.rpt
ep1c12_29_dds/dds.fit.smsg
ep1c12_29_dds/dds.fit.summary
ep1c12_29_dds/dds.flow.rpt
ep1c12_29_dds/dds.map.eqn
ep1c12_29_dds/dds.map.rpt
ep1c12_29_dds/dds.map.summary
ep1c12_29_dds/dds.pin
ep1c12_29_dds/dds.pof
ep1c12_29_dds/dds.qpf
ep1c12_29_dds/dds.qsf
ep1c12_29_dds/dds.qws
ep1c12_29_dds/dds.sof
ep1c12_29_dds/dds.tan.rpt
ep1c12_29_dds/dds.tan.summary
ep1c12_29_dds/dds.vhd
ep1c12_29_dds/dds_assignment_defaults.qdf
ep1c12_29_dds/dds_rom.bsf
ep1c12_29_dds/dds_rom.mif
ep1c12_29_dds/dds_rom.vhd
ep1c12_29_dds/dds_rom_inst.vhd
ep1c12_29_dds/dds_test.bsf
ep1c12_29_dds/dds_test.vhd
ep1c12_29_dds/dds_top.bsf
ep1c12_29_dds/dds_top.vhd
ep1c12_29_dds/pll.bsf
ep1c12_29_dds/pll.vhd
ep1c12_29_dds/pll_inst.vhd
ep1c12_29_dds/_desktop.ini
ep1c12_29_dds/db
ep1c12_29_dds

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