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文件名称:newViterbi217
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- 上传时间：2013-01-19
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基于IEEE802.11n标准,采用verilog语言设计的(2,1,7)卷积码viterbi译码器,支持1/2,2/3,3/4,5/6四种码率的译码,以测试无误-IEEE802.11n standard Verilog language design (2,1,7) convolutional code viterbi decoder support 1/2, 2/3, 3/4, 5/6 four bit rate decoding to test and correct
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acsadd.v
acsCombine.v
acsCompare.v
acsunit.v
distance.v
dRam.v
smaller.v
tb_trace.v
viterbi.v
acsCombine.v
acsCompare.v
acsunit.v
distance.v
dRam.v
smaller.v
tb_trace.v
viterbi.v
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