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文件名称:projet

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [C/C++] [源码]
  • 上传时间：
    2013-03-16
  • 文件大小：
    360.57kb
  • 已下载：
    0次
  • 提 供 者：
    ELR****
  • 相关连接：
    无
  • 下载说明：
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Nous nous proposons de construire un système d’acquisition à partir du « SPARTAN 3A FPGA starter kit board » de XILINX et des périphériques de cette carte dans le cadre du TP « acquisition de données » . Le kit comprend un ADC deux voies (LTC1407A de LINEAR TECHNOLOGY) 14 bits associé à un amplificateur à gain programmable (LTC6912 de LINEAR TECHNOLOGY) pour chacune des deux voies de l’ADC. La fréquence d’échantillonnage par voie est au maximum de 1.5 MHz. Les gains possibles sont 0 :1 :2 :5 :10 :20 :50 :100V/V. Le FPGA SPARTAN 3A doit pouvoir contrô ler l’ADC et l’amplificateur à travers une interface SPI et le séquenceur contrô lant l’ADC. Le schéma ci-dessous reprend le schéma du système DAQ présent sur le kit de développement SPARTAN-Nous nous proposons de construire un système d’acquisition à partir du «　SPARTAN 3A FPGA starter kit board »　de XILINX et des périphériques de cette carte dans le cadre du TP «　acquisition de données » . Le kit comprend un ADC deux voies (LTC1407A de LINEAR TECHNOLOGY) 14 bits associé à un amplificateur à gain programmable (LTC6912 de LINEAR TECHNOLOGY) pour chacune des deux voies de l’ADC. La fréquence d’échantillonnage par voie est au maximum de 1.5 MHz. Les gains possibles sont 0 :1 :2 :5 :10 :20 :50 :100V/V. Le FPGA SPARTAN 3A doit pouvoir contrô ler l’ADC et l’amplificateur à travers une interface SPI et le séquenceur contrô lant l’ADC. Le schéma ci-dessous reprend le schéma du système DAQ présent sur le kit de développement SPARTAN
(系统自动生成,下载前可以参看下载内容)

下载文件列表

projet/_xmsgs/
projet/_xmsgs/pn_parser.xmsgs
projet/Amp_LTC6912_1.vhd
projet/Amp_LTC6912_1_isim_beh.exe
projet/Amp_LTC6912_1_stx_beh.prj
projet/Banc_Test.vhd
projet/Bascule_D.vhd
projet/fr俼uence d'horloge.txt
projet/fuse.log
projet/fuse.xmsgs
projet/fuseRelaunch.cmd
projet/iseconfig/
projet/iseconfig/alrifai_V1.projectmgr
projet/iseconfig/proget_V1.projectmgr
projet/iseconfig/testbench.xreport
projet/isim.cmd
projet/isim.log
projet/isim/
projet/isim/isim_usage_statistics.html
projet/isim/pn_info
projet/isim/precompiled.exe.sim/
projet/isim/precompiled.exe.sim/ieee/
projet/isim/precompiled.exe.sim/ieee/p_1242562249.c
projet/isim/precompiled.exe.sim/ieee/p_1242562249.didat
projet/isim/precompiled.exe.sim/ieee/p_1242562249.nt.obj
projet/isim/precompiled.exe.sim/ieee/p_2592010699.c
projet/isim/precompiled.exe.sim/ieee/p_2592010699.didat
projet/isim/precompiled.exe.sim/ieee/p_2592010699.nt.obj
projet/isim/temp/
projet/isim/temp/amp_ltc6912_1.vdb
projet/isim/temp/amp_ltc6912_1_cfg.vdb
projet/isim/temp/bascule_d.vdb
projet/isim/temp/bascule_d_cfg.vdb
projet/isim/temp/my_package.vdb
projet/isim/temp/testbench.vdb
projet/isim/testbench_isim_beh.exe.sim/
projet/isim/testbench_isim_beh.exe.sim/isimcrash.log
projet/isim/testbench_isim_beh.exe.sim/ISimEngine-DesignHierarchy.dbg
projet/isim/testbench_isim_beh.exe.sim/isimkernel.log
projet/isim/testbench_isim_beh.exe.sim/netId.dat
projet/isim/testbench_isim_beh.exe.sim/testbench_isim_beh.exe
projet/isim/testbench_isim_beh.exe.sim/tmp_save/
projet/isim/testbench_isim_beh.exe.sim/tmp_save/_1
projet/isim/testbench_isim_beh.exe.sim/work/
projet/isim/testbench_isim_beh.exe.sim/work/a_1463710724_0515606320.c
projet/isim/testbench_isim_beh.exe.sim/work/a_1463710724_0515606320.didat
projet/isim/testbench_isim_beh.exe.sim/work/a_1463710724_0515606320.nt.obj
projet/isim/testbench_isim_beh.exe.sim/work/a_1949178628_2372691052.c
projet/isim/testbench_isim_beh.exe.sim/work/a_1949178628_2372691052.didat
projet/isim/testbench_isim_beh.exe.sim/work/a_1949178628_2372691052.nt.obj
projet/isim/testbench_isim_beh.exe.sim/work/a_2405607968_1763303644.c
projet/isim/testbench_isim_beh.exe.sim/work/a_2405607968_1763303644.didat
projet/isim/testbench_isim_beh.exe.sim/work/a_2405607968_1763303644.nt.obj
projet/isim/testbench_isim_beh.exe.sim/work/p_2688103174.c
projet/isim/testbench_isim_beh.exe.sim/work/p_2688103174.didat
projet/isim/testbench_isim_beh.exe.sim/work/p_2688103174.nt.obj
projet/isim/testbench_isim_beh.exe.sim/work/testbench_isim_beh.exe_main.c
projet/isim/testbench_isim_beh.exe.sim/work/testbench_isim_beh.exe_main.nt.obj
projet/isim/work/
projet/isim/work/amp_ltc6912_1.vdb
projet/isim/work/amp_ltc6912_1_cfg.vdb
projet/isim/work/bascule_d.vdb
projet/isim/work/bascule_d_cfg.vdb
projet/isim/work/my_package.vdb
projet/isim/work/testbench.vdb
projet/My_Package.vhd
projet/proget_V1.gise
projet/proget_V1.xise
projet/projet.gise
projet/test_banch.ucf
projet/testbench_beh.prj
projet/testbench_isim_beh.exe
projet/testbench_isim_beh.wdb
projet/testbench_stx_beh.prj
projet/testbench_summary.html
projet/xilinxsim.ini

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