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文件名称:spiV

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [PDF]
  • 上传时间：
    2013-05-03
  • 文件大小：
    2.52mb
  • 已下载：
    0次
  • 提 供 者：
    马****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

FPGA spi通信协议，很全，大家参考，希望对大家有用。-Fpga spi Communication protocol, very full, we refer to the hope that useful.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

spi/
spi/branches/
spi/tags/
spi/tags/asyst_2/
spi/tags/asyst_2/rtl/
spi/tags/asyst_2/rtl/verilog/
spi/tags/asyst_2/rtl/verilog/spi_clgen.v
spi/tags/asyst_2/rtl/verilog/spi_defines.v
spi/tags/asyst_2/rtl/verilog/spi_shift.v
spi/tags/asyst_2/rtl/verilog/spi_top.v
spi/tags/asyst_2/rtl/verilog/timescale.v
spi/tags/asyst_3/
spi/tags/asyst_3/rtl/
spi/tags/asyst_3/rtl/verilog/
spi/tags/asyst_3/rtl/verilog/spi_clgen.v
spi/tags/asyst_3/rtl/verilog/spi_defines.v
spi/tags/asyst_3/rtl/verilog/spi_shift.v
spi/tags/asyst_3/rtl/verilog/spi_top.v
spi/tags/asyst_3/rtl/verilog/timescale.v
spi/tags/initial/
spi/tags/initial/bench/
spi/tags/initial/bench/verilog/
spi/tags/initial/bench/verilog/spi_slave_model.v
spi/tags/initial/bench/verilog/tb_spi_top.v
spi/tags/initial/bench/verilog/wb_master_model.v
spi/tags/initial/doc/
spi/tags/initial/doc/src/
spi/tags/initial/doc/src/spi.doc
spi/tags/initial/rtl/
spi/tags/initial/rtl/verilog/
spi/tags/initial/rtl/verilog/spi_clgen.v
spi/tags/initial/rtl/verilog/spi_defines.v
spi/tags/initial/rtl/verilog/spi_shift.v
spi/tags/initial/rtl/verilog/spi_top.v
spi/tags/initial/rtl/verilog/timescale.v
spi/tags/initial/sim/
spi/tags/initial/sim/run/
spi/tags/initial/sim/run/sim
spi/tags/initial/sim/run/tcl.scr
spi/tags/rel_1/
spi/tags/rel_1/bench/
spi/tags/rel_1/bench/verilog/
spi/tags/rel_1/bench/verilog/spi_slave_model.v
spi/tags/rel_1/bench/verilog/tb_spi_top.v
spi/tags/rel_1/bench/verilog/wb_master_model.v
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spi/tags/rel_1/doc/spi.pdf
spi/tags/rel_1/doc/src/
spi/tags/rel_1/doc/src/spi.doc
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spi/tags/rel_1/rtl/verilog/
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spi/tags/rel_1/sim/run/
spi/tags/rel_1/sim/run/sim
spi/tags/rel_1/sim/run/tcl.scr
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spi/tags/rel_2/bench/
spi/tags/rel_2/bench/verilog/
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sp

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