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文件名称:lab4_5
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介绍说明－－下载内容来自于网络，使用问题请自行百度
用VHDL实现串行除法器，16位被除数，8位除数-Using VHDL serial divider, 16 dividend, divisor 8
(系统自动生成,下载前可以参看下载内容)
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control.vhd
display.vhd
divide.vhd
divider_top.qsf
divider_top.vhd
my_state.vhd
set.vhd
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divider_top.qsf
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my_state.vhd
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