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文件名称:FIR_dida

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [Matlab] [源码]
  • 上传时间：
    2013-08-26
  • 文件大小：
    1.43mb
  • 已下载：
    0次
  • 提 供 者：
    chen****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

自己写的FIR滤波器设计，verilog语言写的，很好用-Write your own FIR filter design, verilog language, easy to use
(系统自动生成,下载前可以参看下载内容)

下载文件列表

FIR_dida/
FIR_dida/FIR.asm.rpt
FIR_dida/FIR.bsf
FIR_dida/FIR.done
FIR_dida/FIR.fit.rpt
FIR_dida/FIR.fit.summary
FIR_dida/FIR.flow.rpt
FIR_dida/FIR.map.rpt
FIR_dida/FIR.map.smsg
FIR_dida/FIR.map.summary
FIR_dida/FIR.pin
FIR_dida/FIR.pof
FIR_dida/FIR.qpf
FIR_dida/FIR.qsf
FIR_dida/FIR.qws
FIR_dida/FIR.sim.rpt
FIR_dida/FIR.sof
FIR_dida/FIR.tan.rpt
FIR_dida/FIR.tan.summary
FIR_dida/FIR.v
FIR_dida/FIR.v.bak
FIR_dida/FIR.vwf
FIR_dida/FIRFIR.bdf
FIR_dida/FIR_1.bsf
FIR_dida/FIR_1.html
FIR_dida/FIR_1.qip
FIR_dida/FIR_1.v
FIR_dida/FIR_1.vec
FIR_dida/FIR_1.vo
FIR_dida/FIR_1_ast.vhd
FIR_dida/FIR_1_bb.v
FIR_dida/FIR_1_coef_int.txt
FIR_dida/FIR_1_constraints.tcl
FIR_dida/FIR_1_input.txt
FIR_dida/FIR_1_mlab.m
FIR_dida/FIR_1_model.m
FIR_dida/FIR_1_msim.tcl
FIR_dida/FIR_1_nativelink.tcl
FIR_dida/FIR_1_param.txt
FIR_dida/FIR_1_silent_param.txt
FIR_dida/FIR_1_st.v
FIR_dida/FIR_assignment_defaults.qdf
FIR_dida/Hlp_tb.v
FIR_dida/db/
FIR_dida/db/FIR.db_info
FIR_dida/db/FIR.sim.cvwf
FIR_dida/db/FIR.sld_design_entry.sci
FIR_dida/db/prev_cmp_FIR.map.qmsg
FIR_dida/db/prev_cmp_FIR.qmsg
FIR_dida/db/prev_cmp_FIR.sim.qmsg
FIR_dida/db/wed.wsf
FIR_dida/fir_compiler-library/
FIR_dida/fir_compiler-library/accum.v
FIR_dida/fir_compiler-library/addr_cnt_dn.v
FIR_dida/fir_compiler-library/addr_cnt_dn_poly.v
FIR_dida/fir_compiler-library/addr_cnt_up.v
FIR_dida/fir_compiler-library/at_sink_mod.v
FIR_dida/fir_compiler-library/at_sink_mod_bin.v
FIR_dida/fir_compiler-library/at_sink_mod_par.v
FIR_dida/fir_compiler-library/at_src_mod.v
FIR_dida/fir_compiler-library/at_src_mod_par.v
FIR_dida/fir_compiler-library/auk_dspip_avalon_streaming_block_sink_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_avalon_streaming_block_source_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_avalon_streaming_controller_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_avalon_streaming_controller_pe_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_avalon_streaming_monitor_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_avalon_streaming_sink_fir_90.ocp
FIR_dida/fir_compiler-library/auk_dspip_avalon_streaming_sink_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_avalon_streaming_sink_model_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_avalon_streaming_source_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_avalon_streaming_source_from_monitor_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_avalon_streaming_source_model_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_delay_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_fast_accumulator_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_fastadd_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_fastaddsub_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_fifo_pfc_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_fir_accumulator_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_fir_adder_tree_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_fir_adders_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_fir_avalon_slave_write_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_fir_coef_banks_fixed_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_fir_data_memory_bank_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_fir_dspblock_bank_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_fir_dspblock_cascade_bank_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_fir_lib_pkg_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_fir_math_pkg_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_fir_memory_simple_dual_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_fir_memory_single_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_fir_memory_true_dual_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_fir_mult_bank_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_fir_top_dec_half_sym_fir_90.ocp
FIR_dida/fir_compiler-library/auk_dspip_fir_top_dec_half_sym_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_fir_top_dec_sym_add_cas_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_fir_top_dec_sym_cas_fir_90.ocp
FIR_dida/fir_compiler-library/auk_dspip_fir_top_int_sym_fir_90.ocp
FIR_dida/fir_compiler-library/auk_dspip_fir_top_int_sym_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_fir_top_sin_sym_fir_90.ocp
FIR_dida/fir_compiler-library/auk_dspip_fir_top_sin_sym_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_lib_pkg_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_math_pkg_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_pfc_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_pipelined_adder_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_roundsat_fir_90.vhd
FIR_dida/fir_compiler-library/auk_dspip_text_pkg_fir_90.vhd
FIR_dida/fir_compiler-library/coef_in_conv.v
FIR_dida/fir_compiler-library/dat_mm_brg.v
FIR_dida/fir_compiler-library/dat_store.v
FIR_dida/fir_compiler-library/dat_store_c.v
FIR_dida/fir_compiler-library/data_cnt_dn_stat.v
FIR_dida/fir_compiler-library/data_cnt_up.v
FIR_dida/fir_compiler-library/data_sel_dec.v
FIR_dida/fir_compiler-library/decoder_we.v
FIR_dida/fir_compiler-library/decoder_we_cen.v
FIR_dida/fir_compiler-library/delay.v
FIR_dida/fir_compiler-library/delay_cen.v
FIR_dida/fir_com

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