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文件名称:clkgen
介绍说明－－下载内容来自于网络，使用问题请自行百度
用ＭＡＴＬＡＢ产生各种时钟信号，对于不同的模块产生适当的始终信号．
(系统自动生成,下载前可以参看下载内容)
下载文件列表
clkgen/clkgen.cr.mti
clkgen/clkgen.mpf
clkgen/clk_div.v
clkgen/clk_gen.v
clkgen/test.v
clkgen/top.fsdb
clkgen/transcript
clkgen/work/_info
clkgen/work/top/verilog.asm
clkgen/work/top/_primary.dat
clkgen/work/top/_primary.vhd
clkgen/work/top
clkgen/work/clk_gen/verilog.asm
clkgen/work/clk_gen/_primary.dat
clkgen/work/clk_gen/_primary.vhd
clkgen/work/clk_gen
clkgen/work/clk_div/verilog.asm
clkgen/work/clk_div/_primary.dat
clkgen/work/clk_div/_primary.vhd
clkgen/work/clk_div
clkgen/work
clkgen
www.dssz.com.txt
clkgen/clkgen.mpf
clkgen/clk_div.v
clkgen/clk_gen.v
clkgen/test.v
clkgen/top.fsdb
clkgen/transcript
clkgen/work/_info
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clkgen/work/top
clkgen/work/clk_gen/verilog.asm
clkgen/work/clk_gen/_primary.dat
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clkgen/work/clk_gen
clkgen/work/clk_div/verilog.asm
clkgen/work/clk_div/_primary.dat
clkgen/work/clk_div/_primary.vhd
clkgen/work/clk_div
clkgen/work
clkgen
www.dssz.com.txt
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