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文件名称:MSK

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [ASM] [源码]
  • 上传时间：
    2014-04-09
  • 文件大小：
    1.65mb
  • 已下载：
    2次
  • 提 供 者：
    王****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

FPGA中实现的MSK调制，带modelsim仿真。实际系统测试通过：载波和调制波信号频率可调。调制框图请参见樊昌信 通信原理247页-MSK modulation implemented in FPGA with modelsim simulation. The actual test system: a carrier wave signal and the modulation frequency is adjustable. See Fan Changxin modulation block diagram of communication theory 247
(系统自动生成,下载前可以参看下载内容)

下载文件列表

MSK/
MSK/Code/
MSK/Code/cos.mif
MSK/Code/cos_romm10b.v
MSK/Code/Fs_Gen.v
MSK/Code/IQ_sin_cos.v
MSK/Code/IQ_sin_cos_mod.v
MSK/Code/IQ_sin_cos_mod.v.bak
MSK/Code/m.v
MSK/Code/MSK.v
MSK/Code/MSK.v.bak
MSK/Code/msk_tb.v
MSK/Code/Muly_10bS.v
MSK/Code/s2p.v
MSK/Code/sin.mif
MSK/Code/sin_rom_10b.v
MSK/Modelsim/
MSK/Modelsim/cos.mif
MSK/Modelsim/cos.ver
MSK/Modelsim/Msk_Sim.cr.mti
MSK/Modelsim/Msk_Sim.mpf
MSK/Modelsim/sin.mif
MSK/Modelsim/sin.ver
MSK/Modelsim/vsim.wlf
MSK/Modelsim/work/
MSK/Modelsim/work/@i@q_sin_cos/
MSK/Modelsim/work/@i@q_sin_cos/verilog.asm
MSK/Modelsim/work/@i@q_sin_cos/verilog.rw
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MSK/Modelsim/work/@i@q_sin_cos/_primary.dbs
MSK/Modelsim/work/@i@q_sin_cos/_primary.vhd
MSK/Modelsim/work/@i@q_sin_cos_mod/
MSK/Modelsim/work/@i@q_sin_cos_mod/verilog.asm
MSK/Modelsim/work/@i@q_sin_cos_mod/verilog.rw
MSK/Modelsim/work/@i@q_sin_cos_mod/_primary.dat
MSK/Modelsim/work/@i@q_sin_cos_mod/_primary.dbs
MSK/Modelsim/work/@i@q_sin_cos_mod/_primary.vhd
MSK/Modelsim/work/@m@s@k/
MSK/Modelsim/work/@m@s@k/verilog.asm
MSK/Modelsim/work/@m@s@k/verilog.rw
MSK/Modelsim/work/@m@s@k/_primary.dat
MSK/Modelsim/work/@m@s@k/_primary.dbs
MSK/Modelsim/work/@m@s@k/_primary.vhd
MSK/Modelsim/work/@m@s@k_tb/
MSK/Modelsim/work/@m@s@k_tb/verilog.asm
MSK/Modelsim/work/@m@s@k_tb/verilog.rw
MSK/Modelsim/work/@m@s@k_tb/_primary.dat
MSK/Modelsim/work/@m@s@k_tb/_primary.dbs
MSK/Modelsim/work/@m@s@k_tb/_primary.vhd
MSK/Modelsim/work/@muly_10b@s/
MSK/Modelsim/work/@muly_10b@s/verilog.asm
MSK/Modelsim/work/@muly_10b@s/verilog.rw
MSK/Modelsim/work/@muly_10b@s/_primary.dat
MSK/Modelsim/work/@muly_10b@s/_primary.dbs
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MSK/Modelsim/work/fs_@gen/verilog.asm
MSK/Modelsim/work/fs_@gen/verilog.rw
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MSK/Modelsim/work/fs_@gen/_primary.dbs
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MSK/Modelsim/work/s2p/verilog.rw
MSK/Modelsim/work/s2p/_primary.dat
MSK/Modelsim/work/s2p/_primary.dbs
MSK/Modelsim/work/s2p/_primary.vhd
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MSK/Modelsim/work/sin_rom_10b/verilog.asm
MSK/Modelsim/work/sin_rom_10b/verilog.rw
MSK/Modelsim/work/sin_rom_10b/_primary.dat
MSK/Modelsim/work/sin_rom_10b/_primary.dbs
MSK/Modelsim/work/sin_rom_10b/_primary.vhd
MSK/Modelsim/work/wsj/
MSK/Modelsim/work/wsj/verilog.asm
MSK/Modelsim/work/wsj/verilog.rw
MSK/Modelsim/work/wsj/_primary.dat
MSK/Modelsim/work/wsj/_primary.dbs
MSK/Modelsim/work/wsj/_primary.vhd
MSK/Modelsim/work/_info
MSK/Modelsim/work/_temp/
MSK/Modelsim/work/_vmake

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