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文件名称:Exemple_1_Clock_24

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [HTML]
  • 上传时间：
    2014-10-13
  • 文件大小：
    2mb
  • 已下载：
    0次
  • 提 供 者：
    b****
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Exemple_1_Clock_24/clock.qpf
Exemple_1_Clock_24/clock.qsf
Exemple_1_Clock_24/clock.qws
Exemple_1_Clock_24/clock.vhd
Exemple_1_Clock_24/clock.vhd.bak
Exemple_1_Clock_24/db/add_sub_2ch.tdf
Exemple_1_Clock_24/db/add_sub_lkc.tdf
Exemple_1_Clock_24/db/add_sub_mkc.tdf
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Exemple_1_Clock_24/db/clock.cmp1.ddb
Exemple_1_Clock_24/db/clock.cmp2.ddb
Exemple_1_Clock_24/db/clock.cmp_merge.kpt
Exemple_1_Clock_24/db/clock.db_info
Exemple_1_Clock_24/db/clock.fit.qmsg
Exemple_1_Clock_24/db/clock.hier_info
Exemple_1_Clock_24/db/clock.hif
Exemple_1_Clock_24/db/clock.ipinfo
Exemple_1_Clock_24/db/clock.lpc.html
Exemple_1_Clock_24/db/clock.lpc.rdb
Exemple_1_Clock_24/db/clock.lpc.txt
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Exemple_1_Clock_24/db/clock.map.kpt
Exemple_1_Clock_24/db/clock.map.qmsg
Exemple_1_Clock_24/db/clock.map.rdb
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