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文件名称:quanjiaqi

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [ASM] [源码]
  • 上传时间：
    2014-11-30
  • 文件大小：
    26.13kb
  • 已下载：
    0次
  • 提 供 者：
    知****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

使用verilog HDL实现全加器的功能-Use verilog HDL to achieve full adder function
(系统自动生成,下载前可以参看下载内容)

下载文件列表

quanjiaqi/jishiqi.v
quanjiaqi/jishiqi.v.bak
quanjiaqi/quanjia1.v
quanjiaqi/quanjia1.v.bak
quanjiaqi/quanjia3.v
quanjiaqi/quanjia3.v.bak
quanjiaqi/quanjiaqi.cr.mti
quanjiaqi/quanjiaqi.mpf
quanjiaqi/transcript
quanjiaqi/t_quanjia3.v
quanjiaqi/t_quanjia3.v.bak
quanjiaqi/vsim.wlf
quanjiaqi/work/@c@n@t10/verilog.asm
quanjiaqi/work/@c@n@t10/_primary.dat
quanjiaqi/work/@c@n@t10/_primary.vhd
quanjiaqi/work/quanjia1/verilog.asm
quanjiaqi/work/quanjia1/_primary.dat
quanjiaqi/work/quanjia1/_primary.vhd
quanjiaqi/work/quanjia3/verilog.asm
quanjiaqi/work/quanjia3/_primary.dat
quanjiaqi/work/quanjia3/_primary.vhd
quanjiaqi/work/t_quanjia3/verilog.asm
quanjiaqi/work/t_quanjia3/_primary.dat
quanjiaqi/work/t_quanjia3/_primary.vhd
quanjiaqi/work/_info
quanjiaqi/work/@c@n@t10
quanjiaqi/work/quanjia1
quanjiaqi/work/quanjia3
quanjiaqi/work/t_quanjia3
quanjiaqi/work
quanjiaqi

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