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文件名称:RISC_CPU

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [HTML]
  • 上传时间：
    2015-12-19
  • 文件大小：
    1.77mb
  • 已下载：
    0次
  • 提 供 者：
    康二***
  • 相关连接：
    无
  • 下载说明：
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失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

毕业设计，基于Xilinx Spartan6自制开发板实验。毕业设计，能够实现简单的计算器。VHDDL-Graduation design, development board based on Xilinx Spartan6 homemade experiment. Graduation design, to achieve a simple calculator. VHDDL
(系统自动生成,下载前可以参看下载内容)

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RISC_CPU/
RISC_CPU/RTL/
RISC_CPU/RTL/ALU.vhd
RISC_CPU/RTL/CPU.vhd
RISC_CPU/RTL/DEC.vhd
RISC_CPU/RTL/EXE_reg.vhd
RISC_CPU/RTL/ID_reg.vhd
RISC_CPU/RTL/IF_reg.vhd
RISC_CPU/RTL/MEM_reg.vhd
RISC_CPU/RTL/RAM.vhd
RISC_CPU/RTL/ROM.vhd
RISC_CPU/RTL/Stack.vhd
RISC_CPU/RTL/control.vhd
RISC_CPU/RTL/fre_div.vhd
RISC_CPU/RTL/gpr.vhd
RISC_CPU/RTL/mux_2_1.vhd
RISC_CPU/RTL/ps2.vhd
RISC_CPU/RTL/top.vhd
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RISC_CPU/UCF/top.ucf
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RISC_CPU/risc/RISC.gise
RISC_CPU/risc/RISC.xise
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RISC_CPU/risc/_ngo/netlist.lst
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RISC_CPU/risc/webtalk.log
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RISC_CPU/risc/xst/dump.xst/top.prj/
RISC_CPU/risc/xst/projnav.tmp/
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RISC_CPU/risc/xst/work/work.vdbl
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