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文件名称:lab4

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
  • 上传时间：
    2017-05-12
  • 文件大小：
    5.57kb
  • 已下载：
    0次
  • 提 供 者：
    j**
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

创建一个digital system，让它可以计算:F0 (X+Y)/2-1,F1 (X+Y)/4-1,建立datapath和control unit，最后烧录进板子里观察屏幕示数和led亮灭。-(X+Y)/2-1, F1　 (X+Y)/4-1,　u5EFA　u7ACBdatapath　u548Ccontrol () () () () () () () () () () () () () () () () () () () () () () () () () () () () () () () Unit　uFF0C　u6700　u540E　u70E1　u5F55　u8FDB　u7Fc　u5B0　u91C　 u5BDF　u5C5F　u5E55　u793A　u6570　u548Cled　u4EAE　u706D　u3002
(系统自动生成,下载前可以参看下载内容)

下载文件列表

lab4/
lab4/alu4.vhd
lab4/CtrlFSM.vhd
lab4/lab4.ucf
lab4/Lab4.vhd
lab4/Lab4.xise
lab4/Lab4_DP.vhd
lab4/ShiftReg.vhd

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