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  • 所属分类：
    VHDL/FPGA/Verilog
  • 标签属性：
    [Matlab] [源码]
  • 上传时间：
    2017-07-07
  • 文件大小：
    29kb
  • 已下载：
    0次
  • 提 供 者：
    WO***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
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如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

使用FPGA+DAC产生DDS，可变频率(user FPGA and DAC generate DDS)
相关搜索： FPGA DDS

(系统自动生成,下载前可以参看下载内容)

下载文件列表

src\AD9777.v
src\ADD_32bit.v
src\ADD_32bit.v.bak
src\ADD_SUM.bsf
src\ADD_SUM.qip
src\ADD_SUM.v
src\ADD_SUM_bb.v
src\ADD_SUM_syn.v
src\Bit10_Multiplexer.v
src\Bit10_Multiplexer.v.bak
src\Bus_Conversion.v
src\Bus_Conversion.v.bak
src\Data_Builder.v
src\Data_Builder.v.bak
src\DDS_rom1.m
src\Delay_1bit.v
src\Delay_1bit.v.bak
src\greybox_tmp\cbx_args.txt
src\MY_DDS.bdf
src\Not_rom_data.v
src\Not_rom_data.v.bak
src\Not_ture_data.v
src\Not_ture_data.v.bak
src\Romdata_15bits_Multiplexer.v
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src\sin1.mif
src\Sin_rom.bsf
src\Sin_rom.qip
src\Sin_rom.v
src\Sin_rom_bb.v
src\Sin_rom_syn.v
src\SPI.v
src\Start_dds.v
src\Start_dds.v.bak
src\greybox_tmp
src

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