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文件名称:SV
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基于dspbuilder的svpwm仿真，可以直接转化为VHDL程序，加载到FPGA中使用(SVPWM simulation based on dspbuilder, can be directly converted to VHDL program, loaded into the use of FPGA)
(系统自动生成,下载前可以参看下载内容)
下载文件列表
| 文件名 | 大小 | 更新时间 |
|---|---|---|
| SV.mdl | 113762 | 2017-11-23 |
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