文件名称:crc16_ccitt
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crc_table.c is for reset seed( 0000 )
crc_table_1.c is for reset seed( ffff)
CRC16_D8_m.v is a verilog module of byte paralle crc.
CRC16_D8_m_tb.v is the testbench file of above module.
crc_table_1.c is for reset seed( ffff)
CRC16_D8_m.v is a verilog module of byte paralle crc.
CRC16_D8_m_tb.v is the testbench file of above module.
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下载文件列表
crc16_ccitt/CRC16_D8_m.v
crc16_ccitt/CRC16_D8_m_tb.v
crc16_ccitt/crc_table.c
crc16_ccitt/crc_table_1.c
crc16_ccitt
www.dssz.com.txt
crc16_ccitt/CRC16_D8_m_tb.v
crc16_ccitt/crc_table.c
crc16_ccitt/crc_table_1.c
crc16_ccitt
www.dssz.com.txt
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