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文件名称:single_clock_divider.rar

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [PDF]
  • 上传时间：
    2012-09-04
  • 文件大小：
    119.07kb
  • 已下载：
    0次
  • 提 供 者：
    miss *****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
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如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

单周期除法器，速度快，满足频率要求，使得单周期内得到除数,Single-cycle divider speed, to meet the frequency requirements
相关搜索： 除法器

(系统自动生成,下载前可以参看下载内容)

下载文件列表

single_clock_divider/CVS/Entries
single_clock_divider/CVS/Repository
single_clock_divider/CVS/Root
single_clock_divider/div_tb.vhd
single_clock_divider/div_unit.vhd
single_clock_divider/single_clock_div.pdf
single_clock_divider/single_clock_div.tar.gz
single_clock_divider/CVS
single_clock_divider

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