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文件名称:clock_verilog.rar

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [Text]
  • 上传时间：
    2012-09-04
  • 文件大小：
    3kb
  • 已下载：
    0次
  • 提 供 者：
    曹***
  • 相关连接：
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verilog语言实现的数字钟，各种定时闹钟功能类似真实的表~利用EDA实验平台实现~~,Verilog language implementation of the digital clock, alarm clock features a variety of regular table similar to the real experimental platform ~ using EDA implementation ~ ~
相关搜索： alarm verilog 闹钟 Verilog 定时

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clock_verilog.txt

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