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文件名称:UART

  • 所属分类:
  • 标签属性:
  • 上传时间:
    2012-10-17
  • 文件大小:
    2.16mb
  • 已下载:
    5次
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  • 下载说明:
    别用迅雷下载,失败请重下,重下不扣分!

介绍说明--下载内容来自于网络,使用问题请自行百度

本人自己编写的FPGA异步串口通信模块(UART),基于QuartusII环境,verilog语言编写,包含仿真和全部程序及说明,验证通过,具有很好的稳定性和参考价值!-I have written of the FPGA asynchronous serial communication module (UART), based on QuartusII the environment, verilog language, including simulation and all the procedures and instructions, validate through, with good stability and reference value!
(系统自动生成,下载前可以参看下载内容)

下载文件列表

UART/UART.qpf
UART/UART.qsf
UART/db/wed.wsf
UART/db/UART.db_info
UART/db/UART.cmp.rdb
UART/db/UART.asm.qmsg
UART/db/UART.(0).cnf.cdb
UART/db/UART.cmp.ecobp
UART/db/prev_cmp_UART.map.qmsg
UART/db/UART.(0).cnf.hdb
UART/db/UART.lpc.txt
UART/db/UART.tan.qmsg
UART/db/mux_5oc.tdf
UART/db/UART.cbx.xml
UART/db/UART.fit.qmsg
UART/db/prev_cmp_UART.qmsg
UART/db/UART.rtlv.hdb
UART/db/UART.sim.qmsg
UART/db/UART.eco.cdb
UART/db/UART.sim_ori.vwf
UART/db/prev_cmp_UART.sim.qmsg
UART/db/mux_cqc.tdf
UART/db/UART.eds_overflow
UART/db/UART.sld_design_entry.sci
UART/db/prev_cmp_UART.fit.qmsg
UART/db/UART.simfam
UART/db/prev_cmp_UART.asm.qmsg
UART/db/prev_cmp_UART.tan.qmsg
UART/db/UART.map.qmsg
UART/db/UART.(1).cnf.cdb
UART/db/UART.lpc.html
UART/db/UART.rpp.qmsg
UART/db/UART.lpc.rdb
UART/db/UART.smp_dump.txt
UART/db/UART.(1).cnf.hdb
UART/db/UART.(2).cnf.cdb
UART/db/UART.(2).cnf.hdb
UART/db/UART.rtlv_sg.cdb
UART/db/UART.pre_map.cdb
UART/db/UART.map_bb.logdb
UART/db/UART.sgdiff.hdb
UART/db/UART.sta.qmsg
UART/db/UART.cmp.logdb
UART/db/UART.fnsim.qmsg
UART/db/UART.rtlv_sg_swap.cdb
UART/db/UART.pre_map.hdb
UART/db/UART.sgdiff.cdb
UART/db/prev_cmp_UART.sta.qmsg
UART/db/UART.sld_design_entry_dsc.sci
UART/db/UART.ae.hdb
UART/db/UART.ace_cmp.bpm
UART/db/UART.sim.hdb
UART/db/UART.sta.rdb
UART/db/UART.asm_labs.ddb
UART/db/UART.map_bb.cdb
UART/db/UART.sta_cmp.7_slow_1200mv_85c.tdb
UART/db/UART.map.cdb
UART/db/UART.sim.rdb
UART/db/UART.map.logdb
UART/db/UART.map.hdb
UART/db/UART.map_bb.hdb
UART/db/UART.ace_cmp.ecobp
UART/db/UART.map.bpm
UART/db/UART.sgate_sm.rvd
UART/db/UART.ace_cmp.cdb
UART/db/UART.hif
UART/db/UART.cmp.cdb
UART/db/UART.ace_cmp.hdb
UART/db/UART.sgate.rvd
UART/db/UART.fnsim.cdb
UART/db/UART.tiscmp.slow_1200mv_85c.ddb
UART/db/clk_jump.tis_db_list.ddb
UART/db/UART.lfp.cdb
UART/db/UART.cuda_io_sim_cache.45um_ss_1200mv_85c_slow.hsd
UART/db/UART.tmw_info
UART/db/UART.cuda_io_sim_cache.45um_ii_1200mv_85c_slow.hsd
UART/db/UART.tis_db_list.ddb
UART/db/UART.cmp.hdb
UART/db/UART.cmp.bpm
UART/db/UART.tiscmp.slow_1200mv_0c.ddb
UART/db/UART.cuda_io_sim_cache.45um_ff_1200mv_0c_fast.hsd
UART/db/UART.tiscmp.fast_1200mv_0c.ddb
UART/db/UART.hier_info
UART/db/UART.fnsim.hdb
UART/db/UART.syn_hier_info
UART/db/UART.map.ecobp
UART/db/UART.map.kpt
UART/db/UART.cmp_merge.kpt
UART/db/UART_global_asgn_op.abo
UART/db/UART.cmp.kpt
UART/baud.v
UART/UART.sim.rpt
UART/receiver.v.bak
UART/UART.map.summary
UART/incremental_db/compiled_partitions/UART.root_partition.map.kpt
UART/incremental_db/compiled_partitions/UART.root_partition.map.atm
UART/incremental_db/compiled_partitions/UART.root_partition.map.hdbx
UART/incremental_db/compiled_partitions/UART.root_partition.cmp.rcf
UART/incremental_db/compiled_partitions/UART.root_partition.cmp.hdbx
UART/incremental_db/compiled_partitions/UART.root_partition.cmp.atm
UART/incremental_db/compiled_partitions/UART.root_partition.cmp.logdb
UART/incremental_db/compiled_partitions/UART.root_partition.cmp.kpt
UART/incremental_db/compiled_partitions/UART.root_partition.map.dpi
UART/incremental_db/compiled_partitions/UART.root_partition.cmp.dfp
UART/incremental_db/README
UART/receiver.v
UART/UART.vwf
UART/UART.map.rpt
UART/UART.flow.rpt
UART/UART.fit.rpt
UART/UART.asm.rpt
UART/UART.tan.rpt
UART/UART.v.bak
UART/UART.v
UART/sopc_builder_log.txt
UART/.sopc_builder/filters.xml
UART/.sopc_builder/preferences.xml
UART/UART.dpf
UART/UART.sta.summary
UART/UART.sta.rpt
UART/output_file.map
UART/UART.pof
UART/UART.qws
UART/UART.pin
UART/UART.fit.smsg
UART/UART.fit.summary
UART/UART.sof
UART/UART.tan.summary
UART/UART.done
UART/transmiter.vhd.bak
UART/transmiter.vhd
UART/receiver.vhd.bak
UART/receiver.vhd
UART/transmiter.v.bak
UART/transmiter.v
UART/incremental_db/compiled_partitions
UART/db
UART/incremental_db
UART/.sopc_builder
UART

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