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文件名称:shuzizhong

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
  • 上传时间：
    2012-11-16
  • 文件大小：
    1.36mb
  • 已下载：
    0次
  • 提 供 者：
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可预置数字钟，用VHDL语言编写，LED显示，普通数字钟表。-Digital clock can be preset using VHDL language, LED display, an ordinary digital watch.
相关搜索： shuzizhong 数字钟 VHDL

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可预制数字钟/SHUZIZHONG/3.shs
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