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文件名称:Comparators_16B

  • 所属分类:
  • 标签属性:
  • 上传时间:
    2008-10-13
  • 文件大小:
    21.41kb
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verilog 实现 优化的16位比较器 可以输出大于,小于,等于。模块化设计,可扩展为32位-Verilog achieve optimization of 16 compared with the output can be greater than, less than, equal to. Modular design, which can be expanded to 32
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Comparators_16B
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Comparators_16B/comparators.cr.mti
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