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文件名称:Multi11Mulply

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [PPT]
  • 上传时间：
    2012-11-16
  • 文件大小：
    434.77kb
  • 已下载：
    0次
  • 提 供 者：
    至***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

本程序是11位带符号位的乘法器，其中最高位为符号位(sign)，中间7位是指数部分(Exponent)，最后3位是尾数(Matissa)。表示数据的范围是-2^-63-----+2^64.该工程文件有完整的程序，以及波形,验证正确。-This procedure is the unsigned 11-bit multiplier, one of the highest for the sign bit (sign), are between 7 part Index (Exponent), the final three are mantissa (Matissa). Express the scope of the data are-2 ^-63-----+ 2 ^ 64. The project document has a complete procedures, as well as waveform, verify that the correct.
相关搜索： 乘法器 VHDL

(系统自动生成,下载前可以参看下载内容)

下载文件列表

Multi11/db/fmul.(0).cnf.cdb
Multi11/db/fmul.(0).cnf.hdb
Multi11/db/fmul.(1).cnf.cdb
Multi11/db/fmul.(1).cnf.hdb
Multi11/db/fmul.(2).cnf.cdb
Multi11/db/fmul.(2).cnf.hdb
Multi11/db/fmul.asm.qmsg
Multi11/db/fmul.asm_labs.ddb
Multi11/db/fmul.cbx.xml
Multi11/db/fmul.cmp.bpm
Multi11/db/fmul.cmp.cdb
Multi11/db/fmul.cmp.ecobp
Multi11/db/fmul.cmp.hdb
Multi11/db/fmul.cmp.logdb
Multi11/db/fmul.cmp.rdb
Multi11/db/fmul.cmp.tdb
Multi11/db/fmul.cmp0.ddb
Multi11/db/fmul.db_info
Multi11/db/fmul.eco.cdb
Multi11/db/fmul.eds_overflow
Multi11/db/fmul.fit.qmsg
Multi11/db/fmul.fnsim.cdb
Multi11/db/fmul.fnsim.hdb
Multi11/db/fmul.fnsim.qmsg
Multi11/db/fmul.hier_info
Multi11/db/fmul.hif
Multi11/db/fmul.map.bpm
Multi11/db/fmul.map.cdb
Multi11/db/fmul.map.ecobp
Multi11/db/fmul.map.hdb
Multi11/db/fmul.map.logdb
Multi11/db/fmul.map.qmsg
Multi11/db/fmul.map_bb.cdb
Multi11/db/fmul.map_bb.hdb
Multi11/db/fmul.map_bb.hdbx
Multi11/db/fmul.map_bb.logdb
Multi11/db/fmul.pre_map.cdb
Multi11/db/fmul.pre_map.hdb
Multi11/db/fmul.psp
Multi11/db/fmul.root_partition.cmp.atm
Multi11/db/fmul.root_partition.cmp.dfp
Multi11/db/fmul.root_partition.cmp.hdbx
Multi11/db/fmul.root_partition.cmp.logdb
Multi11/db/fmul.root_partition.cmp.rcf
Multi11/db/fmul.root_partition.map.atm
Multi11/db/fmul.root_partition.map.hdbx
Multi11/db/fmul.root_partition.map.info
Multi11/db/fmul.rtlv.hdb
Multi11/db/fmul.rtlv_sg.cdb
Multi11/db/fmul.rtlv_sg_swap.cdb
Multi11/db/fmul.sgdiff.cdb
Multi11/db/fmul.sgdiff.hdb
Multi11/db/fmul.signalprobe.cdb
Multi11/db/fmul.sim.cvwf
Multi11/db/fmul.sim.hdb
Multi11/db/fmul.sim.qmsg
Multi11/db/fmul.sim.rdb
Multi11/db/fmul.simfam
Multi11/db/fmul.sld_design_entry.sci
Multi11/db/fmul.sld_design_entry_dsc.sci
Multi11/db/fmul.syn_hier_info
Multi11/db/fmul.tan.qmsg
Multi11/db/fmul.tis_db_list.ddb
Multi11/db/fmul.tmw_info
Multi11/db/mult_lq01.tdf
Multi11/db/prev_cmp_fmul.map.qmsg
Multi11/db/prev_cmp_fmul.qmsg
Multi11/db/prev_cmp_fmul.sim.qmsg
Multi11/db/wed.wsf
Multi11/fmul.done
Multi11/fmul.fit.summary
Multi11/fmul.flow.rpt
Multi11/fmul.map.rpt
Multi11/fmul.pin
Multi11/fmul.pof
Multi11/fmul.qpf
Multi11/fmul.qsf
Multi11/fmul.qws
Multi11/fmul.sim.rpt
Multi11/fmul.sof
Multi11/fmul.vwf
Multi11/mul11.vhd
ReddMe.txt
VHDL主程序的简单注释.txt
浮点数的IEEE标准表示法则.ppt
Multi11/db
Multi11

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