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文件名称:clock

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [WORD]
  • 上传时间：
    2012-11-16
  • 文件大小：
    1.1mb
  • 已下载：
    0次
  • 提 供 者：
    章***
  • 相关连接：
    无
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vhdl 电子钟

计时 上下午 整点报时-VHDL Electronics afternoon bell time on the whole point timekeeping
(系统自动生成,下载前可以参看下载内容)

下载文件列表

vhdl clock/多功能数字钟（要求）.doc
vhdl clock/总体框图.vsd
vhdl clock/数字系统设计报告.doc
vhdl clock/程序总体框图.bmp
vhdl clock/程序文件/test/alert.bsf
vhdl clock/程序文件/test/alert.vhd
vhdl clock/程序文件/test/alert.vhd.bak
vhdl clock/程序文件/test/alert.vwf
vhdl clock/程序文件/test/braz.bsf
vhdl clock/程序文件/test/braz.vhd
vhdl clock/程序文件/test/braz.vhd.bak
vhdl clock/程序文件/test/braz.vwf
vhdl clock/程序文件/test/clock.bdf
vhdl clock/程序文件/test/clock.vhd
vhdl clock/程序文件/test/clock.vhd.bak
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vhdl clock/程序文件/test/count24.vhd.bak
vhdl clock/程序文件/test/count24.vwf
vhdl clock/程序文件/test/count60.bsf
vhdl clock/程序文件/test/count60.vhd
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vhdl clock/程序文件/test/day.vhd.bak
vhdl clock/程序文件/test/day.vwf
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