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文件名称:VHDL

  • 所属分类:
  • 标签属性:
  • 上传时间:
    2012-11-16
  • 文件大小:
    394.59kb
  • 已下载:
    0次
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实现一个10秒倒计时电路,要求使用8*8点阵显示计时结果。在QuartusII平台上设计程序和仿真题目要求,并下载到实验板验证实验结果。-Achieve a 10-second countdown circuit, requires the use of 8* 8 dot matrix display timing results. QuartusII platform in the design process and simulation on the subject request and download to the board to verify the experimental results.
相关搜索: 倒计时 VHDL 点阵显示

(系统自动生成,下载前可以参看下载内容)

下载文件列表

数电实验报告.doc
ya3/db/cmp_state.ini
ya3/db/db/dianzhen.(0).cnf.cdb
ya3/db/db/dianzhen.(0).cnf.hdb
ya3/db/db/dianzhen.asm.qmsg
ya3/db/db/dianzhen.cmp.cdb
ya3/db/db/dianzhen.cmp.ddb
ya3/db/db/dianzhen.cmp.hdb
ya3/db/db/dianzhen.cmp.rdb
ya3/db/db/dianzhen.cmp.tdb
ya3/db/db/dianzhen.dat_manager.dat
ya3/db/db/dianzhen.db_info
ya3/db/db/dianzhen.fit.qmsg
ya3/db/db/dianzhen.hier_info
ya3/db/db/dianzhen.hif
ya3/db/db/dianzhen.icc
ya3/db/db/dianzhen.map.cdb
ya3/db/db/dianzhen.map.hdb
ya3/db/db/dianzhen.map.qmsg
ya3/db/db/dianzhen.pre_map.hdb
ya3/db/db/dianzhen.project.hdb
ya3/db/db/dianzhen.rtlv.hdb
ya3/db/db/dianzhen.rtlv_sg.cdb
ya3/db/db/dianzhen.rtlv_sg_swap.cdb
ya3/db/db/dianzhen.sgdiff.cdb
ya3/db/db/dianzhen.sgdiff.hdb
ya3/db/db/dianzhen.signalprobe.cdb
ya3/db/db/dianzhen.sim.hdb
ya3/db/db/dianzhen.sim.qmsg
ya3/db/db/dianzhen.sim.rdb
ya3/db/db/dianzhen.sim.vwf
ya3/db/db/dianzhen.sld_design_entry.sci
ya3/db/db/dianzhen.sld_design_entry_dsc.sci
ya3/db/db/dianzhen.syn_hier_info
ya3/db/db/dianzhen.tan.qmsg
ya3/db/db/dianzhen_cmp.qrpt
ya3/db/db/dianzhen_sim.qrpt
ya3/db/dianzhen.asm.rpt
ya3/db/dianzhen.done
ya3/db/dianzhen.fit.eqn
ya3/db/dianzhen.fit.rpt
ya3/db/dianzhen.fit.summary
ya3/db/dianzhen.flow.rpt
ya3/db/dianzhen.map.eqn
ya3/db/dianzhen.map.rpt
ya3/db/dianzhen.map.summary
ya3/db/dianzhen.pin
ya3/db/dianzhen.qpf
ya3/db/dianzhen.qsf
ya3/db/dianzhen.qws
ya3/db/dianzhen.sim.rpt
ya3/db/dianzhen.tan.rpt
ya3/db/dianzhen.tan.summary
ya3/db/dianzhen.vhd
ya3/db/dianzhen.vwf
ya3/db/sim.cfg
ya3/db/db
ya3/db
ya3

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