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文件名称:vhdldds0000

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [PDF]
  • 上传时间：
    2012-11-16
  • 文件大小：
    168.28kb
  • 已下载：
    1次
  • 提 供 者：
    李***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
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如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

采用fpga的hdl语言实现dds的信号发生器的设计，性能与传统相比明显提高。-Hdl language using FPGA implementation of the signal generator dds design, performance markedly improved compared with the traditional.
相关搜索： dds signal generator vhdl dds signal generator design using vhdl on FPGA 信号发生器 VHDL

(系统自动生成,下载前可以参看下载内容)

下载文件列表

vhdl语言正弦信号发生器设计/vhdl语言正弦信号发生器设计.pdf
vhdl语言正弦信号发生器设计/基于FPGA的多功能信号发生器.doc
vhdl语言正弦信号发生器设计

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