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文件名称:add

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
  • 上传时间：
    2012-11-16
  • 文件大小：
    13.27kb
  • 已下载：
    0次
  • 提 供 者：
    yig***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

一位全加器源码实现了MAX及其一系列器件实现全加的功能-A full adder and its source code to achieve the MAX series of devices to achieve the functions of the All-Canadian
相关搜索： vhdl source code for full adder

(系统自动生成,下载前可以参看下载内容)

下载文件列表

add/add.acf
add/add.cnf
add/add.fit
add/add.hif
add/add.mmf
add/add.ndb
add/add.pin
add/add.pof
add/add.rpt
add/add.scf
add/add.snf
add/ADD.sym
add/add.vhd
add/LIB.DLS
add/U2103917.DLS
add/U7065527.DLS
add/U7857163.DLS
add

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