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文件名称:fdiv

  • 所属分类:
  • 标签属性:
  • 上传时间:
    2012-11-16
  • 文件大小:
    179.43kb
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基于Quartus II的数控分频器的项目设计,实现对时钟信号的任意进制分频,包含了项目文件和VHDL源代码-NC-based prescaler Quartus II project design, implementation of the clock signal of arbitrary frequency band, including the project files and VHDL source code
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fdiv/db/DVF.(0).cnf.hdb
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fdiv/db/DVF.cmp.tdb
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fdiv/db/DVF.map_bb.logdb
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fdiv/db/DVF.pss
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fdiv/db/DVF.sld_design_entry_dsc.sci
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fdiv/db/prev_cmp_DVF.qmsg
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fdiv/db/prev_cmp_DVF.tan.qmsg
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fdiv/DVF.map.summary
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fdiv/DVF.qws
fdiv/DVF.sim.rpt
fdiv/DVF.sof
fdiv/DVF.tan.rpt
fdiv/DVF.tan.summary
fdiv/DVF.vhd
fdiv/DVF.vhd.bak
fdiv/DVF.vwf
fdiv/db
fdiv

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