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文件名称:jpegVerilog

  • 所属分类:
  • 标签属性:
  • 上传时间:
    2012-11-16
  • 文件大小:
    102.04kb
  • 已下载:
    0次
  • 提 供 者:
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  • 下载说明:
    别用迅雷下载,失败请重下,重下不扣分!

介绍说明--下载内容来自于网络,使用问题请自行百度

FPGA实现jpeg Verilog源代码-FPGA realization of jpeg Verilog source code
(系统自动生成,下载前可以参看下载内容)

下载文件列表

jpegVerilog/fpga-jpeg/dct/dct.v
jpegVerilog/fpga-jpeg/dct/dctu.v
jpegVerilog/fpga-jpeg/dct/dctub.v
jpegVerilog/fpga-jpeg/dct/dct_bench/bench_top.v
jpegVerilog/fpga-jpeg/dct/dct_cos_table.v
jpegVerilog/fpga-jpeg/dct/dct_mac.v
jpegVerilog/fpga-jpeg/dct/dct_syn.v
jpegVerilog/fpga-jpeg/dct/fdct.v
jpegVerilog/fpga-jpeg/dct/huffman/bench/bench_top.v
jpegVerilog/fpga-jpeg/dct/huffman/bench/generic_dpram.v
jpegVerilog/fpga-jpeg/dct/huffman/bench/generic_fifo_lfsr.v
jpegVerilog/fpga-jpeg/dct/huffman/bench/lfsr.v
jpegVerilog/fpga-jpeg/dct/huffman/bench/timescale.v
jpegVerilog/fpga-jpeg/dct/huffman/huffman_dec.v
jpegVerilog/fpga-jpeg/dct/huffman/huffman_enc.v
jpegVerilog/fpga-jpeg/dct/huffman/huffman_tables.v
jpegVerilog/fpga-jpeg/dct/ro_cnt.v
jpegVerilog/fpga-jpeg/dct/rtl_sim/Makefile.txt
jpegVerilog/fpga-jpeg/dct/ud_cnt.v
jpegVerilog/fpga-jpeg/dct/zigzag.v
jpegVerilog/fpga-jpeg/jpeg/bench_top/jpeg_encoder.v
jpegVerilog/fpga-jpeg/jpeg/jpeg_encoder.v
jpegVerilog/fpga-jpeg/jpeg/sim/cds.lib
jpegVerilog/fpga-jpeg/jpeg/sim/hdl.var
jpegVerilog/fpga-jpeg/jpeg/sim/Makefile.txt
jpegVerilog/fpga-jpeg/qnr/attic/div.v
jpegVerilog/fpga-jpeg/qnr/attic/div_us.v
jpegVerilog/fpga-jpeg/qnr/attic/ro_cnt.v
jpegVerilog/fpga-jpeg/qnr/attic/ud_cnt.v
jpegVerilog/fpga-jpeg/qnr/bench/bench_div_top.v
jpegVerilog/fpga-jpeg/qnr/bench/bench_qnr_top.v
jpegVerilog/fpga-jpeg/qnr/bench/timescale.v
jpegVerilog/fpga-jpeg/qnr/div_su.v
jpegVerilog/fpga-jpeg/qnr/div_uu.v
jpegVerilog/fpga-jpeg/qnr/jpeg_qnr.v
jpegVerilog/fpga-jpeg/rgb2ycrcb/modelsim.ini
jpegVerilog/fpga-jpeg/rgb2ycrcb/rgb2ycrcb/_info
jpegVerilog/fpga-jpeg/rgb2ycrcb/rgb2ycrcb.mpf
jpegVerilog/fpga-jpeg/rgb2ycrcb/rgb2ycrcb.v
jpegVerilog/fpga-jpeg/rgb2ycrcb/rgb2ycrcb_testbench.v
jpegVerilog/fpga-jpeg/rgb2ycrcb/rgb2ycrcb_webAddress.txt
jpegVerilog/fpga-jpeg/rgb2ycrcb/tcl_stacktrace.txt
jpegVerilog/fpga-jpeg/rgb2ycrcb/transcript
jpegVerilog/fpga-jpeg/rgb2ycrcb/work/_info
jpegVerilog/fpga-jpeg/run_length_coding/attic/jpeg_rle2.v
jpegVerilog/fpga-jpeg/run_length_coding/bench/bench.v.txt
jpegVerilog/fpga-jpeg/run_length_coding/jpeg_rle.v
jpegVerilog/fpga-jpeg/run_length_coding/jpeg_rle1.v
jpegVerilog/fpga-jpeg/run_length_coding/jpeg_rzs.v
jpegVerilog/fpga-jpeg/dct/huffman/bench
jpegVerilog/fpga-jpeg/dct/dct_bench
jpegVerilog/fpga-jpeg/dct/huffman
jpegVerilog/fpga-jpeg/dct/rtl_sim
jpegVerilog/fpga-jpeg/jpeg/bench_top
jpegVerilog/fpga-jpeg/jpeg/sim
jpegVerilog/fpga-jpeg/qnr/attic
jpegVerilog/fpga-jpeg/qnr/bench
jpegVerilog/fpga-jpeg/rgb2ycrcb/rgb2ycrcb
jpegVerilog/fpga-jpeg/rgb2ycrcb/work
jpegVerilog/fpga-jpeg/run_length_coding/attic
jpegVerilog/fpga-jpeg/run_length_coding/bench
jpegVerilog/fpga-jpeg/dct
jpegVerilog/fpga-jpeg/jpeg
jpegVerilog/fpga-jpeg/qnr
jpegVerilog/fpga-jpeg/rgb2ycrcb
jpegVerilog/fpga-jpeg/run_length_coding
jpegVerilog/fpga-jpeg
jpegVerilog

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