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文件名称:adder

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [ASM] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    66.66kb
  • 已下载：
    0次
  • 提 供 者：
    PUDN*****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

一个verilog的源码程序，用于加法器实验程序-A source of verilog procedures, experimental procedures for the adder
(系统自动生成,下载前可以参看下载内容)

下载文件列表

adder/ise/adder/.untf
adder/ise/adder/adder.bgn
adder/ise/adder/adder.bit
adder/ise/adder/adder.bld
adder/ise/adder/adder.cmd_log
adder/ise/adder/adder.dhp
adder/ise/adder/adder.drc
adder/ise/adder/adder.lfp
adder/ise/adder/adder.lso
adder/ise/adder/adder.mrp
adder/ise/adder/adder.nc1
adder/ise/adder/adder.ncd
adder/ise/adder/adder.ngc
adder/ise/adder/adder.ngd
adder/ise/adder/adder.ngm
adder/ise/adder/adder.ngr
adder/ise/adder/adder.npl
adder/ise/adder/adder.pad
adder/ise/adder/adder.pad_txt
adder/ise/adder/adder.par
adder/ise/adder/adder.pcf
adder/ise/adder/adder.placed_ncd_tracker
adder/ise/adder/adder.prj
adder/ise/adder/adder.routed_ncd_tracker
adder/ise/adder/adder.stx
adder/ise/adder/adder.syr
adder/ise/adder/adder.twr
adder/ise/adder/adder.twx
adder/ise/adder/adder.ucf
adder/ise/adder/adder.ucf.untf
adder/ise/adder/adder.ut
adder/ise/adder/adder.v
adder/ise/adder/adder.xpi
adder/ise/adder/adder_map.ncd
adder/ise/adder/adder_map.ngm
adder/ise/adder/adder_pad.csv
adder/ise/adder/adder_pad.txt
adder/ise/adder/adder_vhdl.prj
adder/ise/adder/automake.log
adder/ise/adder/bitgen.ut
adder/ise/adder/__projnav.log
adder/ise/adder/xst/work/hdllib.ref
adder/ise/adder/xst/work/vlg54/adder.bin
adder/ise/adder/_ngo/netlist.lst
adder/ise/adder/__projnav/adder.gfl
adder/ise/adder/__projnav/adder.xst
adder/ise/adder/__projnav/adder_flowplus.gfl
adder/ise/adder/__projnav/adder_ncdTOut_tcl.rsp
adder/ise/adder/__projnav/bitgen.rsp
adder/ise/adder/__projnav/ednTOngd_tcl.rsp
adder/ise/adder/__projnav/map.log
adder/ise/adder/__projnav/nc1TOncd_tcl.rsp
adder/ise/adder/__projnav/par.log
adder/ise/adder/__projnav/parentAssignPackagePinsApp_tcl.rsp
adder/ise/adder/__projnav/posttrc.log
adder/ise/adder/__projnav/runXst_tcl.rsp
adder/modelsim/adder.cr.mti
adder/modelsim/adder.mpf
adder/modelsim/vsim.wlf
adder/modelsim/work/_info
adder/modelsim/work/adder/verilog.asm
adder/modelsim/work/adder/_primary.dat
adder/modelsim/work/adder/_primary.vhd
adder/modelsim/work/tb_adder/verilog.asm
adder/modelsim/work/tb_adder/_primary.dat
adder/modelsim/work/tb_adder/_primary.vhd
adder/rtl/adder.v
adder/rtl/tb_adder.v
adder/ise/adder/xst/work/vlg54
adder/ise/adder/xst/work
adder/ise/adder/xst
adder/ise/adder/_ngo
adder/ise/adder/__projnav
adder/modelsim/work/adder
adder/modelsim/work/tb_adder
adder/ise/adder
adder/modelsim/work
adder/ise
adder/modelsim
adder/rtl
adder

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