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文件名称:FPGA_DDR_SDRAMverilog

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [PDF]
  • 上传时间：
    2012-11-16
  • 文件大小：
    466.27kb
  • 已下载：
    0次
  • 提 供 者：
    姜****
  • 相关连接：
    无
  • 下载说明：
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失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

基于Xilinx FPGA的DDRSDRAM的Verilog控制代码，使用的FPGA为Virtex-4，实现对DDRSDRAM的简单控制（对一系列地址的写入和读取）。-Xilinx FPGA-based DDRSDRAM the control of the Verilog code, the use of the FPGA for the Virtex-4, to achieve a simple DDRSDRAM control (on a series of addresses to write and read).
相关搜索： ddrsdram code in verilog FPGA DD

(系统自动生成,下载前可以参看下载内容)

下载文件列表

基于FPGA的DDR SDRAMverilog代码/mem_interface_top.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_addr_gen_0.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_backend_fifos_0.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_backend_rom_0.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_cmp_rd_data_0.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_controller_iobs_0.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_data_gen_16.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_data_path_0.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_data_path_iobs_0.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_data_tap_inc.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_data_write_0.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_ddr_controller_0.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_idelay_ctrl.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_infrastructure.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_infrastructure_iobs_0.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_iobs_0.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_main_0.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_parameters_0.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_pattern_compare8.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_RAM_D_0.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_rd_data_0.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_rd_data_fifo_0.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_rd_wr_addr_fifo_0.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_tap_ctrl_0.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_tap_logic_0.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_test_bench_0.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_top_0.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_user_interface_0.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_v4_dm_iob.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_v4_dqs_iob.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_v4_dq_iob.txt
基于FPGA的DDR SDRAMverilog代码/mem_interface_top_wr_data_fifo_16.txt
基于FPGA的DDR SDRAMverilog代码/使用 Virtex-4 FPGA 器件实现DDR SDRAM控制器.pdf
基于FPGA的DDR SDRAMverilog代码

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