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当前位置: 首页 资源下载 搜索资源 - 204 188

搜索资源列表

  1. rs_encoder

    0下载:
  2. 此代码是用于DVB系统的信道编码模块,采用(204,188)编码方式,编码后前188个字节是信息位,后16个字节为冗余位。思绪仿真后,通过验证。
  3. 所属分类:通讯编程

    • 发布日期:2008-10-13
    • 文件大小:105386
    • 提供者:lilinyan
  1. C源代码实例

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  2. 包含220个C语言的各种源程序:001 第一个C程序 002 运行多个源文件 003 求整数之积 004 比较实数大小 005 字符的输出 006 显示变量所占字节数 007 自增/自减运算 008 数列求和 009 乘法口诀表 010 猜数字游戏 011 模拟ATM(自动柜员机)界面 012 用一维数组统计学生成绩 013 用二维数组实现矩阵转置 014 求解二维数组的最大/最小元素 015 利用数组求前n个
  3. 所属分类:Windows编程

    • 发布日期:2009-06-04
    • 文件大小:3250828
    • 提供者:79446210
  1. 数据结构的C++描述

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  2. 目 录 译者序 前言 第一部分 预备知识 第1章 C++程序设计 1 1.1 引言 1 1.2 函数与参数 2 1.2.1 传值参数 2 1.2.2 模板函数 3 1.2.3 引用参数 3 1.2.4 常量引用参数 4 1.2.5 返回值 4 1.2.6 递归函数 5 1.3 动态存储分配
  3. 所属分类:数据结构常用算法

    • 发布日期:2009-10-17
    • 文件大小:5125525
    • 提供者:gufeng20081010
  1. WL40987330 C语言算法集

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  2. 目录 第一部分  基础篇   001  第一个C程序  002  运行多个源文件  003  求整数之积  004  比较实数大小  005  字符的输出  006  显示变量所占字节数  007  自增/自减运算  008  数列求和  009  乘法口诀表  010&
  3. 所属分类:Windows编程

    • 发布日期:2008-12-21
    • 文件大小:3245365
    • 提供者:wl409873350
  1. RS_204_188_decoder

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  2. 使用verilog完成了RS编码的设计,编码参数为输入188,输出204-The use of Verilog coding RS completed the design, coding parameters for the importation of 188, the output 204
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-12-08
    • 文件大小:14535
    • 提供者:小米
  1. Tsr

    0下载:
  2. DVB 能完整的解析出TS流文件中的PAT,PMT,NIT,CAT信息,并且能兼容188和204的TS流文件-DVB can be a complete parse out the TS stream file in the PAT, PMT, NIT, CAT information, and can be compatible with the 188 and 204 of the TS stream file
  3. 所属分类:Windows Develop

    • 发布日期:2017-11-11
    • 文件大小:5170125
    • 提供者:邓伟
  1. RS(204_188)decoder

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  2. 实现rs译码的好的参考资料,rs(204,188) 包含了5个模块,求解伴随式。BM算法,钱搜索,forney纠错算法模块-failed to translate
  3. 所属分类:邮电通讯系统

    • 发布日期:2013-12-09
    • 文件大小:11192
    • 提供者:uodsi
  1. 188135a9844b

    0下载:
  2. rs(204,188)译码器VHDL语言源代码-failed to translate
  3. 所属分类:Compiler program

    • 发布日期:2017-11-26
    • 文件大小:14048
    • 提供者:周达
  1. rs_204_188----v1.0

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  2. RS 编码和解码Verilog Code, 实现了RS(204,188)的编码和译码;-RS Coding and Decoding Verilog code, implement RS(204,188)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-12-08
    • 文件大小:2335744
    • 提供者:zhufull
  1. RS(204-188)decoder

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  2. rs_decoder.v(顶层文件), SyndromeCalc.v(计算伴随式), BM_KES.v(BM求解关键方程), Forney.v(Forney算法求误差样值), CheinSearch.v(搜索错误位置),ff_mul.v(有限域乘法)。 ROM及初始化文件: rom_inv.v(求逆运算), rom_power.v(求幂运算); rom_inv.mif(ROM初始化文件), rom_power.mif(ROM初始化文件)。 仿真波形:
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:15449
    • 提供者:杜洵
  1. fpga_DESIGN_examples

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  2. 自己收集的常用的FPGA模块设计,大家分享啊 异步FIFO设计/伪随机序列应用设计/积分梳状滤波器(CIC)设计/伽罗华域GF(q)乘法器设计/除法器设计/常用加法器设计/常用乘法器设计/RS(204,188)译码器的设计/CORDIC数字计算机的设计-Common FPGA module design your own collection, to share ah Asynchronous FIFO design/application design pseudo-random s
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:27766
    • 提供者:老于
  1. RS(204-188)decoder_verilog

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  2. 采用verilog实现的有限域GF(28)弱对偶基乘法器,本原多项式: p(x) = x^8 + x^4 + x^3 + x^2 + 1 ,多项式基: {1, a^1, a^2, a^3, a^4, a^5, a^6, a^7},弱对偶基: {1+a^2, a^1, 1, a^7, a^6, a^5, a^4, a^3+a^7}-Verilog achieved using the finite field GF (28) weak dual basis multiplier
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:14279
    • 提供者:刘建涛
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