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搜索资源列表

  1. DMA_2440

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  2. DMA通道设计,实现数据快速传输,无需经过CPU,在2440 平台运行,成功编译,代码完整-DMA channel design, implement fast data transmission, without going through the CPU, running at 2440 platform, successfully compile, code integrity
  3. 所属分类:Driver develop

    • 发布日期:2017-04-29
    • 文件大小:24563
    • 提供者:zhaomingmin
  1. add32

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  2. 由1位加法器级联得到的32位加法器 是设计单周期cpu的时候的基本部件-use 1 adders to be a 32 adder it is necessary for you to design a cpu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-30
    • 文件大小:109658
    • 提供者:Richar
  1. chip_code_for_verilog

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  2. 片上系统设计思想的code,非常好的学习cpu原理的code-hao hao hao hao hao haoh hao
  3. 所属分类:Linux-Unix program

    • 发布日期:2017-05-11
    • 文件大小:2113912
    • 提供者:liwanmei
  1. dsp28035cla

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  2. CLA是一个32位浮点数学加速器,专为独立于TMS320C28x CPU内核工作而设计,以分担复杂的高速控制算法。-CLA is a 32-bit floating-point math accelerator, specially designed for independent of the TMS320C28x CPU kernel work, to share the complex high speed control algorithm.
  3. 所属分类:DSP program

    • 发布日期:2017-04-24
    • 文件大小:188989
    • 提供者:赵静
  1. 110104010104

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  2. 解决的主要问题 (1)MFC界面设计 (2)模拟生产者消费者的互斥操作 (3)各信号量及互斥体的使用 线程 线程是程序独立运行的基本单位,一个程序通过执行多个线程可以提高机器本身资源的利用率,同时也可以完成多任务并行运行的操作,多线程可以实现并行处理,避免了某项任务长时间占用CPU时间。 互斥体 互斥体与临界区很相似,但是使用时相对复杂一些,它不仅可以在同一应用程序的线程间实现同步,还可以在不同的进程间实现同步,从而实现资源的安全共享。 信号量 信号量是一个
  3. 所属分类:OS Develop

    • 发布日期:2017-05-20
    • 文件大小:5292514
    • 提供者:曾小丽
  1. risc8_cpu_verilog

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  2. 该实例设计的RSIC-CPU总线结构采用数据线(8位)和指令线(12位)独立分离的哈弗结构,把存储寄存器RAM当做寄存器来寻址使用以方便编程。-The example design of RISC-CPU bus architecture uses a data line (8) and command line (12) is separated with the Harvard architecture, the storage register addressing uses RAM as
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:625349
    • 提供者:荣志强
  1. 8bit_CPU

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  2. 用logisim设计的8位精简指令集cpu,有需要的话以后会开发编译器。-Using logisim design of the 8 bit reduced instruction set CPU, there is a need to develop after the compile
  3. 所属分类:Other systems

    • 发布日期:2016-05-29
    • 文件大小:26624
    • 提供者:盘古
  1. exp4_05_cpu_timer

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  2. 用DSP2812的CPU定时器进行设计,控制LED等亮灭时间。-control the time of light of the led by CPU Timer
  3. 所属分类:DSP program

    • 发布日期:2017-04-30
    • 文件大小:233997
    • 提供者:xwf
  1. SimpleCPU

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  2. 分别对运算器、寄存器组以及控制器进行设计,最后将其组合为一个简单的8位CPU,并能够加载测试程序进行测试-Respectively, calculator, and a controller register set design, and finally combined into a simple 8-bit CPU, and able to load test program
  3. 所属分类:Project Design

    • 发布日期:2017-05-07
    • 文件大小:1237938
    • 提供者:vermouth
  1. dsp28335-sch-pcb-kai-fa-ban-2

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  2. 自己画的dsp 28335的cpu核心板,给单位的自动化产品检测台使用,在在使用中大放异彩,dsp软件采用matlab模型设计 我只用了1天的时间完成了大概半个月的工作量,非常好赶紧下载吧。-His paintings DSP 28335 CPU core board, for automation product testing station units, in shine in use, DSP software using MATLAB model design I use the 1
  3. 所属分类:Other systems

    • 发布日期:2017-04-30
    • 文件大小:203806
    • 提供者:王衷曲
  1. jiyucpu

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  2. 基于多CPU的目标识别与跟踪系统设计 -Target recognition and tracking system based on multi-CPU and multi-CPU Target Recognition System Based Tracking
  3. 所属分类:Project Design

    • 发布日期:2017-05-01
    • 文件大小:216350
    • 提供者:宋艺敏
  1. JCHENG2

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  2. 设计一个程序模拟进程管理的过程,采用时间片轮转法,进程占用CPU的时间片有每个进程的优先数来确定。(约定:每个优先数对应10分钟)-design a simulation process management process using time-Web, the process of CPU time for each and every piece of the process to determine the priority number. (Agreement : each corre
  3. 所属分类:ADO-ODBC

    • 发布日期:2017-04-13
    • 文件大小:2225
    • 提供者:w36392fulut
  1. JCHENG2

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  2. 设计一个程序模拟进程管理的过程,采用时间片轮转法,进程占用CPU的时间片有每个进程的优先数来确定。(约定:每个优先数对应10分钟)-design a simulation process management process using time-Web, the process of CPU time for each and every piece of the process to determine the priority number. (Agreement : each corre
  3. 所属分类:ADO-ODBC

    • 发布日期:2017-04-13
    • 文件大小:2018
    • 提供者:v5jjjiab
  1. syn_wr

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  2. 一般来说,CPU的读写时钟会引入到PLD中,笔者利用CPU的读写时钟实现同步读写寄存器,提高设计的可靠性。因此这种建模方式是推荐的CPU读写PLD寄存器建模方式-In general, CPU clock reading and writing will be introduced to the PLD, the author uses the CPU to read and write clock synchronized read and write registers, improve d
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:83966
    • 提供者:一哥
  1. CPU_Design

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  2. 基于VHDL的CPU的设计,本科课程设计,实现了一个指令集,能计算加减乘。-CPU design VHDL-based undergraduate curriculum design and implementation of a set of instructions, subtraction, multiplication, can be calculated.
  3. 所属分类:Other systems

    • 发布日期:2017-05-09
    • 文件大小:1952045
    • 提供者:
  1. 进程调度

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  2. 设计一个有 N个进程共行的进程调度程序。进程调度算法:采用最高优先数优先的调度算法(即把处理机分配给优先数最高的进程)和先来先服务算法。每个进程有一个进程控制块(PCB)表示。进程控制块可以包含如下信息:进程名、优先数、到达时间、需要运行时间、已用CPU时间、进程状态等等。进程的优先数及需要的运行时间可以事先人为地指定(也可以由随机数产生)。进程的到达时间为进程输入的时间。进程的运行时间以时间片为单位进行计算。每个进程的状态可以是就绪 W(Wait)、运行R(Run)、或完成F(Finish)三
  3. 所属分类:数据结构常用算法

    • 发布日期:2016-10-30
    • 文件大小:3239
    • 提供者:liuyutong66700
  1. nibbler

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  2. 一个4位CPU的设计,并且使用数量很少的74系列芯片制作出一个简单的计算机,可以驱动1602液晶屏,蜂鸣器和LED灯。-A 4-bit CPU design, and use a small number of 74 series chips to produce a simple computer, you can drive 1602 LCD screen , buzzer and LED lights.
  3. 所属分类:assembly language

    • 发布日期:2017-05-14
    • 文件大小:3080478
    • 提供者:李明晓
  1. CPU_design_Example

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  2. 设计的CPU字长为16位,可以实现子程序调用,分支,循环及各种算术逻辑运算等功能。 访存的指令采用寄存器间址寻址(R)或是基址寻址X(R)实现, -Design CPU 16 word length can be achieved subroutine calls, branches, loops, and various arithmetic and logical operations and other functions. Between instruction fetch re
  3. 所属分类:Project Design

    • 发布日期:2017-05-04
    • 文件大小:447163
    • 提供者:赵安
  1. Colfax-HOW-Day-01

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  2. 介绍了英特尔至强处理器和英特尔Xeon Phi协处理器和讨论它们的功能和目的。我们也开始介绍便携式的,面向未来的并行编程和讨论在英特尔MIC架构的高性能的先决条件:线程的并行性,矢量化和优化的内存访问模式。本课程将介绍本地的规划模型英特尔Xeon Phi协处理器,允许重用代码的应用程序设计为通用的CPU。会议的实践部分演示了如何在Linux操作系统(OS)在主机上运行的操作系统间的协处理器,以及如何使用英特尔的编译器上运行的处理器的本地应用程序。-Intel Architecture In
  3. 所属分类:MPI

    • 发布日期:2017-05-05
    • 文件大小:21023
    • 提供者:黄雪
  1. 操作系统—进程调度

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  2. 操作系统—进程调度。设计一个有几个进程并发执行的进程调度程序,每个进程由一个进程控制块(PCB)表示,进程控制块通常应包括下述信息:进程名,进程优先数,进程需要运行的时间,占用CPU的时间以及进程的状态等,且可按照调度算法的不同而增删。
  3. 所属分类:编程文档

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