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搜索资源列表

  1. DRAM

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  2. 所属分类:Project Design

    • 发布日期:2017-04-25
    • 文件大小:130556
    • 提供者:sq
  1. dpram2

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  2. vhdl写的双口ram,真正实现双口通信-I write vhdl dual ram, true dual-port communication
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-12
    • 文件大小:2832195
    • 提供者:fenglei
  1. Based_on_dual-port_AM_of_the_single-chip_communica

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  2. 基于双口的RAM的单片机通信,初学者学习有帮助。-Based on dual-port RAM of the single-chip communications, will help beginners to learn.
  3. 所属分类:SCM

    • 发布日期:2017-04-05
    • 文件大小:23423
    • 提供者:张先呈
  1. yacc.tar

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  2. mips处理器,将指令和数据放到一个双端口ram里存储-mips processor, the instructions and data into a dual-port ram to store
  3. 所属分类:Other systems

    • 发布日期:2017-05-17
    • 文件大小:4382753
    • 提供者:李仓
  1. IDT7007RAM

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  2. IDT7007高速双端口RAM及其应用 包括详细的功能原理说明-IDT7007 High-speed dual-port RAM and its application include a detailed descr iption of the Function Principle
  3. 所属分类:SCM

    • 发布日期:2017-04-05
    • 文件大小:214661
    • 提供者:tianjiawei
  1. jj

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  2. 本题设计一个数字存储示波器,以Xilinx公司20万门FPGA芯片为核心,辅以必要的外围电路(包括信号调理、采样保持、内部触发、A/D转换、D/A转换和I/O模块),利用VHDL语言编程,实现了任意波形的单次触发、连续触发和存储回放功能,并按要求进行了垂直灵敏度和扫描速度的挡位设置。信号采集时,将外部输入信号经信号调理模块调节到A/D电路输入范围,经A/D转换后送入FPGA内部的双口RAM进行高速缓存,并将结果通过D/A转换送给通用示波器进行显示,完成了对中、低频信号的实时采样和高频信号的等效采
  3. 所属分类:其他小程序

    • 发布日期:2017-06-10
    • 文件大小:546457
    • 提供者:黄奇家
  1. SCdpramM.tar

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  2. dual port RAM (modular code)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:3016
    • 提供者:Debjit
  1. dualportram

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  2. this is a code of dual port ram
  3. 所属分类:Applications

    • 发布日期:2017-04-10
    • 文件大小:1047
    • 提供者:rakhi
  1. RAM2x64C_1

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  2. 双口RAM用于数据存储和读取,在FFT处理器重,快速的读取和存储数据,可以提高处理器速度-Dual-port RAM for data storage and reading, in the FFT processor heavy, fast read and store data, can improve the processor speed
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:2101
    • 提供者:姚兴波
  1. dual_port_rom

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  2. dual port ram, it is having two data lines and two address lines at a time we can access two data from the two data lines
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:709
    • 提供者:srinivas
  1. m_decoder

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  2. 恢复以曼彻斯特编码格式输入的mdi信号成实际数据并存储在双端口RAM后以中断方式通知DSP读取数据,所需双端口RAM程序可以从相应的FPGA编译系统中产生-A return to the Manchester encoded signal is input into the actual data mdi and stored in the dual-port RAM notify the DSP after the break to read the data, the required du
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:2541
    • 提供者:周宽裕
  1. m_encoder

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  2. 将写入的数据用曼彻斯特码格式从meout口输出,所需内部存储单元可根据所使用不同的FPGA类型由相应的编译软件产生所需双端口RAM模块-The data will be written by Manchester code format from meout port output, the required internal storage unit can be used according to the different types of FPGA Compiler software f
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-25
    • 文件大小:2511
    • 提供者:周宽裕
  1. dp_ram

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  2. 双口RAM的设计,采用Verilog HDL语言编写。-Dual-port RAM design, using Verilog HDL language.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:1907
    • 提供者:信仰
  1. NET2

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  2. This file with the wavelet transf Mallat implementation of wavelet Verilog hdl code modules for radi Modelsim 6.6 crack, can be used f A written using Verilog DDR2 cont Simple CPU VHDL implementation an Dual-port RAM design, usi
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1852409
    • 提供者:sansfroid
  1. ram_dp_sr_sw[1]

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  2. dual port ram control-dual port ram control dual port ram control dual port ram control
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:816
    • 提供者:xl
  1. memory_cores

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  2. 通用ram源码包,包括双口ram,单口ram,fifo等-general ram source package,include dual port ram,single port ram,fifo,etc.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:36471
    • 提供者:
  1. DoubleRAM

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  2. actel fpga kit 双端口RAM 实验-actel fpga kit dual-port RAM test
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:614170
    • 提供者:zhouwj
  1. dpram

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  2. thi is a dual port ram
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:857
    • 提供者:kiran dash
  1. ram_fpgavhdl

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  2. fpga vhdl实现一个标准双端口ram,可以作为单端口或者双端口用 -fpga vhdl achieve a standard dual-port ram, can be used as a single port or dual port with a
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:3383
    • 提供者:站长
  1. real_module

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  2. 对进来的数据进行乒乓操作,例如0-63出来的结果是31-0,63-32.进来和出去为同一时钟,且都是流水线方式,结构为双口RAM.-Ping-pong on the incoming data operations, such as 0-63, the results are 31-0,63-32. Come in and out of the same clock, and are pipelined, the structure of dual-port RAM.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1915223
    • 提供者:王海生
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