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ispLEVER培训教程
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用VHDL语言在CPLD_FPGA上实现浮点运算
- 用VHDL语言在CPLD/FPGA上实现浮点运算的方法-in VHDL CPLD / FPGA achieve floating-point computation methods
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- CPLD FPGA常用protel库.rar-CPLD FPGA used the Protel. Rar
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- 学习FPGA CPLD的入门文档，比较适合初学者-learning portal CPLD FPGA files, suitable for beginners
cpld_fpga_source_code
- cpld fpga 一些应用实例程序的源代码. -cpld fpga application procedures for some of the source code.
digitalsecondwatch(VHDL)
- 应用ＶＨＤＬ、ＣＰＬＤ、ＥＤＡ开发软件设计数字系统,能够显著增强设计的灵活性,提高产品的性能,减轻设计的工作量,缩短设计周期。传统的“固定功能集成块+连线”的设计方法正逐步地缩小应用范围,而基于芯片的设计方法正成为电子系统设计的主流。ＶＨＤＬ语言、ＣＰＬＤ/ＦＰＧＡ、ＥＤＡ开发软件已成为设计复杂数字电路系统的重要工具。-use VHDL, CPLD, EDA software to design digital system, can significantly improve design f
VHDL_cpld
- 用CPLD做了个FPGA的FPP下载时序，验证过。-done with CPLD - FPGA FPP download timetables tested.
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- EDA高手入门必看，FPGA-CPLD-开发流程。
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- CPLD/FPGA设计中的时钟应用讲解 及其实例
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- eda技术的说明,程序VHDL(电梯\\键扫\\交通灯\\步进电机)CPLD/FPGA
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- ALTER的CPLD/FPGA配置芯片的手册，很有用的
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- LATTICE公司的CPLD/FPGA的ISP下载电缆PCB设计图。
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easy-CPLD
- 学习CPLD/FPGA很好的电子书．讲得很好．-Learning CPLD/FPGA good books. Put it very well.
fpga-study
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- 本频率计基于CPLD/FPGA实现。 50MHZ标准频率为CPLD内部时钟信号，被测方波为信号发生器产生的方波信号，显示电路由TTL芯片及七段数码管组成的电路，自校正输出由CPLD输出已知频率的测试方波信号，可将其输入至测试端口，进行系统精度校正。 -The frequency meter based on CPLD/FPGA implementation. 50MHZ standard CPLD internal clock signal frequency, square-wave test
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- 数字频率计在FPGAEP4CE10F17C8上的功能实现和运用(Application of digital cymometer in FPGA)
用CPLD和Flash实现FPGA配置
- 通过CPLD和外部Flash芯片对FPGA进行配置。(By CPLD and external Flash chip of FPGA configuration.)