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  1. crc16_ccitt

    1下载：
  2. crc_table.c is for reset seed( 0000 ) crc_table_1.c is for reset seed( ffff) CRC16_D8_m.v is a verilog module of byte paralle crc. CRC16_D8_m_tb.v is the testbench file of above module.

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：3242
    • 提供者：樊文杰
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