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ModelSim电子系统分析及仿真
- 此文档详细说明了如何利用Modelsim软件对FPGA逻辑代码进行功能仿真和时序仿真的方法，并通过相关例子进行讲解说明(This document explains in detail how to use Modelsim software to perform functional simulation and time series simulation of FPGA logic code, and explain how to use some examples.)
FP_adder
- 32 bit floating point adder with testbench
HDL_equation
- Verilog Program to implement the function f=x+yz and Testbench for all the possible inputs using For Loop
adder
- 实现了加法器功能，包含testbench(Implements the adder function)
31条CPUtest
- CPU testbar 关于31条CPU的测试数据(CPU test 31 cmd CPU testbench & testdata)
uart_rx
- Verilog实现的RS232发送和接收程序，有完成的verilog代码，testbench等。(UART send and receive verilog code, including verilog source code, testbench etc.)
uvm实战源码
- uvm实战教程源码，丰富的uvm demo testbench,可以学习uvm各个阶段的testbench搭建技巧，能学习到大量的uvm testbench搭建技能，比如factory和寄存器模型等重要机制，非常值得学习
ethernet_ip_verilog
- 以太网的ip,用verilog写的，包含testbench,用于FPGA以太网设计参考
NCO VHDL IMPLEMENTATION
- its NCO vhdl implementation very useful and helpfull for beginners. it has vhdl files and testbench. wish you best of luck.
W25Q80NE verilog Model
- SPI FLASH官方仿真模型方便modelsim testbench调试仿真(Official simulation model facilitates debugging and simulation)
通用异步收发器
- 用Verilog编写的uart通用异步收发器带testbench
2D的DCT变换
- 二维DCT变换，附源码以及testbench，以及相应的数学知识
SPI接口Verilog实现
- 里面有主机发送模块和从机接收模块。主机发送32位16进制数（一位一位发送），工作在模式0。压缩文件内代码可直接运行，另附上testbench文件可以进行modelsim仿真。此代码根据论坛里一位大哥的代码改编，后来找不到是谁了。。。使用状态机编写主机的发送模块，由于项目仅仅需要主机发送所以从机的接收模块没有写成32位的，但是代码风格清晰，可以直接修改，复写率极高且非常好理解！