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搜索资源列表

  1. W5300_IF

    2下载：
  2. 实现FPGA与W5300 芯片的百兆以太网通信 ，实际项目中应用很多(Fast Ethernet communication between FPGA and W5300 chip, the actual project in many applications)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2018-01-01
    • 文件大小：4096
    • 提供者：bug赵

  1. Linux_rev3.1

    0下载：
  2. Altera FPGA PCIe驱动，在实际项目中使用(Altera FPGA PCIe driver, used in the actual project)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2018-01-05
    • 文件大小：275456
    • 提供者：qiangang

  1. SNAKE

    0下载：
  2. 基本的verilog贪吃蛇项目（微机原理课程设计）(The basic Verilog snake program (Microcomputer Principle Course Design))

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2018-01-10
    • 文件大小：1273856
    • 提供者：某WAP

  1. 《HELLO FPGA》-项目实战篇-V1.1版

    0下载：
  2. 各种实例的FPGA实现，对学习FPGA有一定的帮助，希望大家能够采纳。(The FPGA realization of the digital clock has some help for learning FPGA, and I hope you can adopt it.)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2018-01-10
    • 文件大小：8495104
    • 提供者：小艾525

  1. AT24C02_IIC

    0下载：
  2. Quartus II 项目，AT24C02 IIC通信接口，可实现读写功能。(This zip contains an AT24C02 IIC interface, which can read from 24c02 and write data into it.)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2018-04-19
    • 文件大小：7487488
    • 提供者：蝠蝙

  1. lcd5110_耗费资源少

    0下载：
  2. Quartus II 项目，可驱动LCD5110液晶显示屏。(This zip file contains a quartus ii project, which can driven the LED screen LCD5110.)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2018-04-19
    • 文件大小：4725760
    • 提供者：蝠蝙

  1. 基准电路ISCAS`89.zip

    0下载：
  2. 基准电路ISCAS`89.zip包含了 基本所有的S电路 和C电路，已经在做项目的使用了，没有任何的错误，欢迎大家下载，学习和相互交流。

  3. 所属分类：VHDL编程

  1. Edege_detect

    1下载：
  2. 边沿检测模块，实际项目中验证； 功能：上升沿、下降沿检测(Edege detect module Func : rising_edge falling_edge detect)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2018-04-20
    • 文件大小：140288
    • 提供者：郝熊

  1. cy4ex1

    0下载：
  2. 特权同学FPGA开发板的verilog项目代码(the verilog code project of Tequan Altera cyclone4 FPGA development board)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2018-04-21
    • 文件大小：32768
    • 提供者：xiaowang2018

  1. 华为FPGA设计流程指南

    0下载：
  2. FPGA设计指南，帮助新手快速上手学习FPGA。为以后项目开发垫下基础。(design guide of FPGA)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2018-04-21
    • 文件大小：35840
    • 提供者：321等风来

  1. pid_controller

    0下载：
  2. 项目总结了PID的基本算法和参数确定的方法，控制PWM步进电机(The PID controller IP core performs digital proportional-integral-derivative controller algorithm.)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2018-04-28
    • 文件大小：385024
    • 提供者：余平

  1. sdram_640X480_full

    0下载：
  2. 基于FPGA的640*480的sdram项目，使用verilog语言，教学项目教学项目(The SDRAM project of 640*480 based on FPGA, the use of the Verilog language, the teaching project teaching project)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2018-04-29
    • 文件大小：23251968
    • 提供者：用小脑思考

  1. device_dri

    0下载：
  2. 该程序结合iic驱动程序，可用自动检测硬件的寄存器配置参数是否正确，项目中已使用过(With the IIC driver, the program can automatically detect whether the hardware's register configuration parameters are correct. The program has been used in the project.)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2018-04-29
    • 文件大小：2048
    • 提供者：橙子很好吃

  1. McBSP_8bit_Asyn

    0下载：
  2. 基于FPGA的Mcbsp通信源码，经过项目实测检验(Mcbsp communication source code based on FPGA,Through the test of the project.)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2018-04-29
    • 文件大小：1024
    • 提供者：Trigger_Z

  1. mj10

    0下载：
  2. 实现门禁系统，可以做网店实战的项目，对接数据库，不过里面没有数据库想对应的测试数据(The implementation of the entrance guard system, can do online shop actual projects, docking database, but there is no database to corresponding test data in it.)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2018-04-18
    • 文件大小：21455872
    • 提供者：qqb

  1. uart

    1下载：
  2. 实现串口的收发，可以稳定的运行，经过测试，可以完全应用于项目中。(The implementation of the serial port and transceiver, can run stable)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2020-05-07
    • 文件大小：7168
    • 提供者：小网忒小

  1. uart

    1下载：
  2. 电脑端发送数据与FPGA接收数据程序，uart模块，以及一部分项目里包含的其他的程序(Program for sending data from computer and receiving data by FPGA, UART module)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2019-10-26
    • 文件大小：18400256
    • 提供者：godxun

  1. SDI_controller

    2下载：
  2. 项目:用到FPGA驱动GV7600输出SDI信号，输出分辨率1920*1080p，首先，了解GV7600芯片的特性功能，按照bt1120协议传输10位Y，Cb，Cr数据；其次，我的项目中用的是10位通道分时复用传输Y，Cb，Cr数据；配置引脚很重要，当初verilog代码写好了，因为硬件引脚配置错误，导致调试一直不通；同时，sof文件也要一直更新(Based on FPGA to design the drive controller of GV7600)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2020-09-13
    • 文件大小：2596864
    • 提供者：Davemissyou

  1. SPI接口Verilog实现

    1下载：
  2. 里面有主机发送模块和从机接收模块。主机发送32位16进制数（一位一位发送），工作在模式0。压缩文件内代码可直接运行，另附上testbench文件可以进行modelsim仿真。此代码根据论坛里一位大哥的代码改编，后来找不到是谁了。。。使用状态机编写主机的发送模块，由于项目仅仅需要主机发送所以从机的接收模块没有写成32位的，但是代码风格清晰，可以直接修改，复写率极高且非常好理解！

  3. 所属分类：VHDL编程

  1. AHB_SRAM

    0下载：
  2. AHB_SRAM的设计验证代码，比较简单的小项目

  3. 所属分类：VHDL编程

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