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文件名称:uart

  • 所属分类：
    VHDL/FPGA/Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2018-06-06
  • 文件大小：
    7kb
  • 已下载：
    1次
  • 提 供 者：
    小*****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

实现串口的收发，可以稳定的运行，经过测试，可以完全应用于项目中。(The implementation of the serial port and transceiver, can run stable)
相关搜索： verilog的uart串口收发

(系统自动生成,下载前可以参看下载内容)

下载文件列表

文件名大小更新时间
rtl\clkdiv.v 826 2017-02-03
rtl\clkdiv.v.bak 644 2015-11-04
rtl\testdata.v 1636 2015-11-04
rtl\testdata.v.bak 908 2015-11-04
rtl\uartctrl.v 4838 2016-02-25
rtl\uartrx.v 4120 2017-02-03
rtl\uartrx.v.bak 3480 2015-11-04
rtl\uarttx.v 3726 2017-02-04
rtl\uart_test.v 1675 2017-02-04
rtl\uart_test.v.bak 341 2015-11-04
rtl 0 2018-05-11

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