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搜索资源列表

  1. park

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  2. 该程序是用VHDL制作的停车场停车位显示系统的源码-The program is produced with VHDL display system of parking spaces with source code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:336.57kb
    • 提供者:杨一峰
  1. lab4showTAs

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  2. 4 seg display, button debouncer, and controller for parking meter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:710.75kb
    • 提供者:notjustcarbon
  1. SOTP_BIKE_OS

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  2. 停车控制系统代码,实现启动触发控制,伺服马达定位控制。-Parking control system code and achieve start trigger control, servo motor positioning control.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:4.41kb
    • 提供者:Light
  1. parking_lot_rev1.0

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  2. This Verilog source is to monitor the count of cars in 4 floors in parking lot. monitoring method is to use sensors to count Cars to enter into or leave out. Cars number is basic number enough small to learn algorithms.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:85.33kb
    • 提供者:龍 龍
  1. counter

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  2. 停车场计数器的设计,分别计数进入停车场的车辆数目和离开停车场的车辆数目。- The design of the parking lot counter, into the parking lot were counting the number of vehicles and leaving the parking lot number of vehicles.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:374.23kb
    • 提供者:春霞
  1. lywpass

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  2. 停车场的计时计费自动显示电路的EDA的VHDL语言课程设计-The parking lot of the timing and charging automatically show circuit EDA VHDL language curriculum design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:1.15mb
    • 提供者:李志
  1. parking-counter-design

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  2. 利用FPGA编程-------实现“停车场计数器设计”-Use of FPGA programming------- parking counter design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:876.39kb
    • 提供者:初昀
  1. eda

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  2. 基于VHDL实现的停车场停车位显示系统的设计,使用可编程逻辑芯片FPGA构成的停车位显示系统。-The design of car parking spaces display system based on FPGA is a very practical Subject, and close to our lives. This subject is the design of a times 8 parking spaces display based on the FPGA in VH
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-22
    • 文件大小:4.43kb
    • 提供者:娓娓小宝
  1. car_count

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  2. car_enter,car_exit分别表示有车辆进入停车场和离开停车场。count1和count2是两个计数器,分别计数进入停车场的车辆数目和离开停车场的车辆数目。total=count1-count2, 表示停在停车场中的车辆数目。lot_full表示停车场已满,即total的大小等于预置的停车场最大停车数(例如32)。 lot_empty表示停车场车辆数目为零。-car_enter, car_exit vehicles entering the car park and leave the
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-17
    • 文件大小:392.03kb
    • 提供者:吴胜兵
  1. parkingfee

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  2. 数字系统课程设计-自助停车缴费系统,该程序模拟汽车入库出库,进行计时和计费。-Digital System Design Course- Self-parking payment system, the program simulates a car storage library for timing and billing
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-25
    • 文件大小:8.14mb
    • 提供者:林铭洲
  1. Frequency-divider

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  2. 利用Verilog设计的在停车场情况下的模拟的分频器和计数器的代码-The use of Verilog design in the parking lot in case of analog frequency divider and counter code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-01
    • 文件大小:9.98kb
    • 提供者:陆晓忆
  1. Timing-

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  2. 利用verilog设计的停车场中的计数器计时器和计费器,完成智能管理效果-Use the counter timer and meter parking lot in the Verilog design, intelligent management
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:4.53kb
    • 提供者:陆晓忆
  1. jiaotongdeng-FPGA

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  2. 交通灯控制器控制两个主干道交叉路口的交通,路口车辆多,直行信号、左转弯信号分开显示,a,b两个主干道的通行时间相等,其中指示直行的绿灯亮30 s,指示左转弯的绿灯亮12 s,绿灯变至红灯时,黄灯亮3 s,以便于车辆能停在停车线内,红灯信号的最后3 s相应的黄灯也同时亮,以便提示驾驶人员准备起步。在两个主干道路口都配备传感器用来检测有无车辆通行。当两个主干道都有车辆时,自动处于主干道a绿灯,主干道b红灯的状态,然后轮流切换通行。当主干道a无车辆时,自动处于主干道b绿灯,主干道a红灯的状态;反之亦然
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2.1mb
    • 提供者:江楠
  1. wcnkv

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  2. About ultrasonic parking radar ranging, cordic matlab simulation algorithm, Six degrees of freedom to achieve inverse kinematics algorithm.
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-26
    • 文件大小:6kb
    • 提供者:feijenhou
  1. 1227

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  2. Really is a good program, About ultrasonic parking radar ranging, ICA (Principal Component Analysis) algorithm and procedures.
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-30
    • 文件大小:7kb
    • 提供者:ningtanbai
  1. car_detect

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  2. 停车场中车辆进出的检测与记录,可得出停车场的车数(The number of vehicles in the parking lot can be obtained by detecting and recording vehicle entry and exit.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-05-02
    • 文件大小:39kb
    • 提供者:小明与小明
  1. Car Parking Module FPGA Zedboard

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  2. This project is based on the car parking module it is working condition
  3. 所属分类:VHDL编程

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