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dds-design
- * DEscr iptION: DDS design BY PLD DEVICES. * * AUTHOR: Sun Yu * * HISTORY: 12/06/2002 *-* DEscr iptION : DDS BY PLD design Online. * * AUTHOR : Sun Yu * * HISTORY : 12/06/2002 *
DSPuva16
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PCB(Cadence)
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Multiplier.rar
- 乘法器 所占资源很少 很好的一个乘法器 史书上的一个例子 说得很好啊,Multiplier good share of scarce resources in the history books on a multiplier an example of very good
edastudy
- 介绍EDA技术历史和现状及发展趋势，设计方法，其中包括一个小的例程-Describes the history and current status of EDA technologies and development trends, design methodology, which includes a small routine
verilog_tech
- 本文介绍Verilog HDL语言的发展历史和它的主要能力。并对各种使用进行详细讲解。-This article describes the development of Verilog HDL language and its history, the primary capacity. And explain in detail the various use.
verilog
- 我用过的verilog大量历程，适合初学者，-verilog lot of history, suitable for beginners
verilog_tutorial
- Chapter 1 Introduction Chapter 2 History of Verilog Chapter 3 Design and Tool Flow Chapter 4 My First Program in Verilog Chapter 5 Verilog HDL Syntax and Semantics Chapter 6 Gate Level Modeling Chapter 7 User Defined Primitives Chapter
Jewish
- 乍一看书名，许多读者可能会感到奇怪：为什么说左手犹太人右手温州人呢？为什么不是其他人？近二千年来，即使有颠沛流离，即使被驱赶打压，犹太商人还是整个商业世界的龙头老大，漫长的历史长河中，印度商人、中国商人、*商人都曾风云一时，但他们都只能屈居于犹太商人的阴影下。-At first glance the title, many readers might wonder: Why is the Jews left hand Wenzhou it? Why not others? Nearly two
sopc
- sopc 详解 史上最全的FPGA代码，及完整的niosII项目创建过程-sopc Detailed history of the most complete FPGA code, and complete the project creation process niosII
LAB18
- 学校最新试验箱配套历程，这是最后一个实验-New chamber supporting the school history, this is the last experiment
AdcClock
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AdcData
- Device: Virtex-5 -- Author: Marc Defossez -- Entity Name: AdcDataMultiChnl -- Purpose: Four channel version of the data capturing for a Texas Instruments ADC -- Tools: ISE, XST -- Limitations: none -- -- Revision History:-Device: Virtex
Verilog-HDL-
- 关于Verilog HDL的介绍。包括Verilog hdl的发展历史，语法应用介绍-On the Verilog HDL descr iption. Including Verilog hdl history of development, syntax described applications
Circuit-Design-with-VHDL
- VHDL数字电路设计教程 作者：（巴西）佩德罗尼（Pedroni,V.A.） 著，乔庐峰 等译 本书采用将数字电路系统设计实例与可编程逻辑相结合的方法，通过大量实例，对如何采用VHDL进行电路设计进行了全面阐述。 本书分为三大部分：首先详细介绍VHDL语言的背景知识、基本语法结构和VHDL代码的编写方法；然后介绍VHDL电路单元库的结构和使用方法，以及如何将新的设计加入到现有的或自己新建立的单元库中，以便于进行代码的分割、共享和重用；最后介绍PLD和FPGA的发展历史、主流厂
Ndianzhengunde
- 点阵显示新历 温度滚动,自己写的通俗易懂，有C语语言基础的都可以看懂 ，经测试可直接使用。 -The dot matrix display the history of the new temperature scroll, written in easy to understand, in C language based can understand, has been tested and can be used directly.
uart-to-GPIO.vhd
- -- Filename ﹕ uart.vhd -- Author ﹕ZRtech -- Descr iption ﹕串口接收与发送程序 -- 本模块的功能是验证实现和PC机进行基本的串口通信的功能。需要在PC机上安装一个串口调试工具来验证-- 程序的功能。程序实现了一个收发一帧10个bit（即无奇偶校验位）的串口控制器，10个bit是1位起始位-- 8个数据位，1个结束位。串口的波特律由程序中定义的div_par参数决定，更改该参数可以实现相应的波-- 特率。程序当前设定的div_
PIPELINE
- （包含详细说明文档和简单汇编转机器码翻译器）五级流水线实现MIPS指令集（30条）含异常处理。结构采用多分支预测结构（基于历史的动态分支预测）-(Contains detailed documentation and compilation turn simple machine code translator) five pipelined MIPS instruction set (30) with exception handling. Structure using multi-bran
P137_4_12_odd_even
- vhdl实现奇数和偶数的分频，因偶数的分频有很多历程，但奇数的分析较为繁琐，故将此结合到一起便于分析操作和分析。-VHDL to achieve the odd and even frequency, the frequency of the Division has a lot of history, but the odd number of analysis is more cumbersome, it will be combined to facilitate the analysis
fft_32k
- FFT 32K点设计实例v1.0.0自述文件 本自述文件包含以下部分： 工具要求 o Quartus II编译 o ModelSim仿真模型 o MATLAB模型(FFT 32K Point Design Example v1.0.0 README File This readme file for the Fast Fourier Transform (FFT) 32K Point Design contains information about the design exam