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搜索资源列表

  1. vedio_collection.rar

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  2. 在这个压缩包里,包含了关于视频采集知识的一些基本的介绍。并且在里面还包含了一个基于spartan-3E的视频采集实验,The compressed pack contains some fundemental introdutions about video collections .What s more ,there is a referenced lab on vedio collection which is based on spartan-3E!
  3. 所属分类:Video Capture

    • 发布日期:2017-05-12
    • 文件大小:2871158
    • 提供者:艾巍
  1. ISE_lab19

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  2. 俄罗斯方块VHDL实现,。该设计由下面模块组成:键盘输入模块,游戏控制模块,图像显示模块,文字显示模块,存储单元,复用单元和VGA 控制模块组成。其中图像显示模块和文字显示模块复用VGA 控制模块。游戏控制模块,图像显示模块和文字显示模块通过存储单元交换数据。-Tetris VHDL implementation. The design consists of the following modules: Keyboard input module, the game control modul
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-15
    • 文件大小:3850145
    • 提供者:雷旦
  1. CPU

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  2. 一个多周期CPU的完整设计,quartus平台,Verilog实现,内含实验报告,和详细的各模块功能表-Complete a multi-cycle CPU design, quartus platform, Verilog implementation, includes lab reports, and a detailed menu of each module
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-09-20
    • 文件大小:6606848
    • 提供者:
  1. MultipleNumbersCalculator

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  2. Multiple Numbers Calculator (source code and LAB notes)
  3. 所属分类:Other systems

    • 发布日期:2017-04-03
    • 文件大小:1018407
    • 提供者:eknngx
  1. 13105886-vhdl-lab-programs

    0下载:
  2. vhdl programme on lfsr
  3. 所属分类:Project Design

    • 发布日期:2017-04-25
    • 文件大小:290259
    • 提供者:rahul
  1. matladfilefordecom

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  2. mat lab codes for watermarking
  3. 所属分类:Multimedia program

    • 发布日期:2017-04-02
    • 文件大小:13326
    • 提供者:govindu
  1. pingpang

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  2. 本实验在实验室实现了对于简易的乒乓球游戏的模拟,以发光二极管的移动来模拟乒乓球的移动,转向表示击球,并实现积分。-In this study, achieved in the lab for a simple table tennis game simulation, in order to light-emitting diodes to simulate the movement of table tennis movement, turning that ball and achieve
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:325537
    • 提供者:wanjiabao
  1. WatchForLab

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  2. This was the first lab assigmnet in the course CPU Architecture, creat a basic watch
  3. 所属分类:Other systems

    • 发布日期:2017-04-09
    • 文件大小:1140685
    • 提供者:zarbob
  1. experiment5_1

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  2. VHDL实验5,七段数码显示译码器设计。1)用VHDL设计7段数码管显示译码电路,并在VHDL描述的测试平台下对译码器进行功能仿真,给出仿真的波形。-VHDL Lab 5, Seven-Segment Display Decoder. 1) design using VHDL 7 segment LED display decoder circuit, and the VHDL descr iption of the decoder under test platform for functio
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:143764
    • 提供者:童长威
  1. VideoLoopback

    0下载:
  2. VHDL写的完整的图像采集与处理的程序,经实验,完全调通 -vhdl program about the picture process,and it is doing well in the lab.
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-03
    • 文件大小:658350
    • 提供者:eingates
  1. Verilog+lab+3+-+HTN+lab+2

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  2. a lab by vhdl, let discover and enjoy it now
  3. 所属分类:Development Research

    • 发布日期:2017-04-09
    • 文件大小:1666182
    • 提供者:huỳ nh an
  1. VERILOG_VLSI_LAB_MANUAL

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  2. VHDL Lab Manual useful for lab purpose
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1921154
    • 提供者:Vinodh
  1. lab

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  2. VHDL Lab manual useful for experiment purpose
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:1001103
    • 提供者:Vinodh
  1. 50973937-VHDL-Report

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  2. Introduction This report is organized as following.First, it is divided into chapter 2 to chapter 12. Within each chapter, VHDL code is presented at the beginning of each problem. Then, simulation results for these codes is also included. For s
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:1017320
    • 提供者:phitoan
  1. vhdl1

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  2. vhdl lab for using labarories
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-14
    • 文件大小:3340548
    • 提供者:mustafa
  1. lab3

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  2. VHDL Lab 3 – Arithmetic & State Machines In this lab we will look at arithmetic circuits that add, subtract, and multiply numbers. Each type of circuit will be implemented in two ways: first by writing VHDL code that describes the require
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:1221880
    • 提供者:sunyan
  1. A-Simplified-VHDL-UART

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  2. In embedded systems, the processor that we choose for our design may not come with built-in peripherals. Therefore, designers will have to implement these devices in hardware keeping in mind that they will need to interface to the processor. In this
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:375158
    • 提供者:mezzich
  1. VHDL-Design-lab-presentation

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  2. Presentation introduction to VHDL language and some useful experiments
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1878077
    • 提供者:waleed
  1. vhdl-lab-report

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  2. vhdl实验报告,关于4位选择器,在maxplusII下运行-vhdl lab report
  3. 所属分类:ELanguage

    • 发布日期:2017-11-14
    • 文件大小:2887
    • 提供者:宋兵
  1. LAB

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  2. SAM VHDL编码,包括数据选择器,加法器,简易逻辑电路,有限状态机等(FSM SAM ALU and many other different parts)
  3. 所属分类:其他

    • 发布日期:2020-11-18
    • 文件大小:6144
    • 提供者:TimeParaodgs
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