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  1. uart

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  2. vhdl编写，完成了uart的接口设计，包括信号检测，判决等-vhdl prepared to complete the uart interface design, including signal detection, decision, etc.

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-05-01
    • 文件大小：771100
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