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  1. digital_clock

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  2. 自己用verilog HDL写的一个数字钟模块,包括校时功能,在Maxplusii下调试和下载通过(A digital clock module written by Verilog HDL, including timing function, debugging and downloading through Maxplusii.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-05-02
    • 文件大小:3072
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