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  1. PARABOLA

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  2. c编程环境下做出 抛物线(简单程序),点3个点做出抛物线,仅做初学c图形编程的范例-made under the parabola (a simple procedure), the point made three points parabola only do that when c graphical programming paradigm
  3. 所属分类:2D图形编程

    • 发布日期:2008-10-13
    • 文件大小:1.75kb
    • 提供者:了了
  1. pipe3D

    0下载:
  2. ini adalah sebuah pipa segi enam 3D, yang dapat berputar.
  3. 所属分类:3D Graphic

    • 发布日期:2017-04-13
    • 文件大小:1.75kb
    • 提供者:anz
  1. bianjiegenzong

    0下载:
  2. 实现边界跟踪算法,输入二值图像,进行边界跟踪,输出边界像素信息,存入一维数组中。-Boundary tracking algorithm to achieve the input binary image, the boundary tracking, output boundary pixel information stored in one-dimensional array.
  3. 所属分类:2D Graphic

    • 发布日期:2017-04-04
    • 文件大小:1.75kb
    • 提供者:张花
  1. speaker_divider

    0下载:
  2. FPGA上蜂鸣器的驱动及测试程序,Verilog HDL语言-The divider and test program of the speaker on FPGA, in Verilog HDL language.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1.75kb
    • 提供者:吴笑
  1. ellipse_Trigono

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  2. draw the trigonometric ellipse using java-draw the trigonometric ellipse using java
  3. 所属分类:2D Graphic

    • 发布日期:2017-04-07
    • 文件大小:1.75kb
    • 提供者:khalid2304
  1. Matryce

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  2. Few eeprom dumps od laptop LCD sceens.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:1.75kb
    • 提供者:xangel
  1. LCDNTROL

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  2. verilog/vhdl LCD水灯程序-Spartan3E开发板调试通过-verilog/vhdl LCD light program-Spartan3E water development board debugging
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:1.75kb
    • 提供者:xxit
  1. fft_16

    0下载:
  2. 16点的fft程序,入口参数为(输入数据,输出数据)-16 points of the fft program, the entrance parameters (input data, output data)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1.75kb
    • 提供者:木偶然
  1. fdtd_3d_src_tfsf

    0下载:
  2. 三维平面波随时间的传播情况,FDTD演示。-The three-dimensional plane wave spread over time, FDTD demo.
  3. 所属分类:2D Graphic

    • 发布日期:2017-11-16
    • 文件大小:1.75kb
    • 提供者:andrew
  1. lcd_12864_dirive

    0下载:
  2. HS12864的驱动,verilog语言编写,,,,,希望有用-HS12864 drive, verilog language,,,,, I hope useful
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:1.75kb
    • 提供者:徐振华
  1. TestSleep

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  2. 无线传感器网络学习TinyOS和nesC的一个典型例子,用于测试节点休眠-this is a typical study case for tinyos and nesC, for test sleep
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-13
    • 文件大小:1.75kb
    • 提供者:blue
  1. spatiotemporal_computing_core

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  2. 用VHDL实现时空混沌:耦合映像格子(CML)-The spatiotemporal chaos of coupled tent map lattice implemented by VHDL.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1.75kb
    • 提供者:曹绿晨
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