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  1. verilog

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  2. 一个桶形移位寄存器的.v文件,含testbench
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1.14kb
    • 提供者:QU YIFAN
  1. 移位寄存器

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  2. First in first out寄存器的verilog源代码
  3. 所属分类:VHDL编程

    • 发布日期:2009-02-22
    • 文件大小:1.14kb
    • 提供者:sh0205
  1. CZT变换

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  2. CZT变换的C语言程序
  3. 所属分类:DSP编程

    • 发布日期:2011-06-03
    • 文件大小:1.14kb
    • 提供者:flykarry
  1. wallace_pp_hafa

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  2. wallace tree,partial products,half adder and full adder
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.14kb
    • 提供者:siva
  1. TSA5511

    0下载:
  2. I2C control of TSA5511
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.14kb
    • 提供者:tmanev
  1. m-operand-n-bit-adder

    0下载:
  2. n bit m operand adder
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:1.14kb
    • 提供者:isnehil
  1. testUSART

    0下载:
  2. 将一块板的发送并口转为串口,完成两块板的通信-Will the board parallel port to send a serial port, complete two boards communications
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:1.14kb
    • 提供者:IDNIDNIDN
  1. AHB

    0下载:
  2. 比较好的Verilog实现的AHB master。-Better AHB Verilog realization of the master.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-24
    • 文件大小:1.14kb
    • 提供者:冯磊
  1. selfbalancecar

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  2. 基于arduino 的自平衡车 有简单算法-basic on arduino self-balance car
  3. 所属分类:SCM

    • 发布日期:2017-04-12
    • 文件大小:1.14kb
    • 提供者:唐一凡
  1. tanxin_beibao

    0下载:
  2. 以背包问题为例,介绍贪心算法解决得到一个最优值-Knapsack problem as an example to introduce a greedy algorithm to solve the optimal value
  3. 所属分类:SCM

    • 发布日期:2017-04-12
    • 文件大小:1.14kb
    • 提供者:qiaoa70ieii
  1. miaobiao

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  2. 用硬件描述语言Verilog HDL完成秒表设计模块,使用数码管。-Using hardware descr iption language Verilog HDL to complete the stopwatch design module, using digital tube.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1.14kb
    • 提供者:eaou
  1. seg_example

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  2. DE2-115 seg example source code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1.14kb
    • 提供者:jdj
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