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  1. spi_master

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  2. 用Verilog写的SPI代码,可读可写,刚仿真完,还没上板,尴尬,主要是官方限制不上传就不能下载~~~~~~~~~~~~~~ 下面的英文是百度翻译过来的,鬼畜的我都不知道啥意思~~~~(The SPI code written in Verilog is readable and writable. After the simulation is finished, it is not yet on board. Awkwardly, it is mainly that official r
  3. 所属分类:VHDL/FPGA/Verilog

  1. VHDL简易电子琴设计(1).doc

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  2. 这是一个简单的基于vhdl的电子琴,有自动播放和使用按键来制作不同的音色。(The design of a simple electronic organ based on VHDL, with the automatic playing and the use of keystrokes to make different tones)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-29
    • 文件大小:122kb
    • 提供者:找你呢
  1. exp_fft_test_724

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  2. 在quartus软件中调用FFT的IP核,编辑IP核的驱动模块,使得IP核读入数据进行处理,输出数据。使用modelsim进行联合仿真。(In the quartus software, the IP kernel of FFT is called, and the driver module of the IP kernel is edited, so that the IP kernel is read into the data for processing and output data
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-29
    • 文件大小:26.28mb
    • 提供者:XHF72
  1. Assignment-1.3.tar

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  2. verilog codes for different basic digital circuits elements
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-29
    • 文件大小:38kb
    • 提供者:guy03
  1. Assignment-2.1.tar

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  2. verilog codes for different basic digital circuits elements new
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-30
    • 文件大小:34kb
    • 提供者:guy03
  1. Assignment-2.2.tar

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  2. verilog-HDL codes for different basic digital circuits elements
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-29
    • 文件大小:26kb
    • 提供者:guy03
  1. Assignment-2.3.tar

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  2. HDL code using verilog
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-29
    • 文件大小:19kb
    • 提供者:guy03
  1. Q1.tar

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  2. implementation of basic elecronics components using verilog HDL
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-29
    • 文件大小:1kb
    • 提供者:guy03
  1. Q2.tar

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  2. vereilog design files for beginer
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-29
    • 文件大小:1kb
    • 提供者:guy03
  1. Q3.tar

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  2. hdl using verilog lenguage
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-29
    • 文件大小:1kb
    • 提供者:guy03
  1. Q4-a.tar

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  2. verilog coding beginer level
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-29
    • 文件大小:1kb
    • 提供者:guy03
  1. Q4-b.tar

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  2. beginer level verilog coding
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-29
    • 文件大小:1kb
    • 提供者:guy03
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