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  1. LCD

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  2. FPGA用于LCD12864的显示程序,采用并行接口,显示固定内容-verilog for 12864 screen
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1.4kb
    • 提供者:baiqiujian
  1. IAR

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  2. 数字频率计 msp430 f6638 和 fpga 的开发板 使用fpga来计算频率 使用430 来显示控制-The digital frequency meter f6638 MSP430 and FPGA development board use FPGA to calculate the frequency using 430 to display control
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2.32mb
    • 提供者:zsmjburning
  1. Encoder

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  2. The program using verilog language to decribe encoder x1 x2 and x4
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:868.81kb
    • 提供者:Vu Phan
  1. adc0809

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  2. ADC0809驱动,VHDL语言描述,开发环境QUARTUS-ADC0809 driver, VHDL language, development environment QUARTUSII
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:637byte
    • 提供者:
  1. pcitree

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  2. pcitree用于查看pci、pcie的总线情况,适用于总线开发等情况-pcitree for viewing pci, pcie bus case for bus development, etc.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:389.74kb
    • 提供者:果果
  1. counter

    0下载:
  2. Counter code in verilog for counting till 59.-Counter code in verilog for counting till 59.99
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:514byte
    • 提供者:Uzair
  1. Led_dec

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  2. LED decoder code in verilog for Spartan 3 FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:849byte
    • 提供者:Uzair
  1. clock

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  2. Clock generator code in Verilog for Stop Watch
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1.04kb
    • 提供者:Uzair
  1. LEDdisplay

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  2. LED display Code for stopwatch in Verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1.48kb
    • 提供者:Uzair
  1. stopwatch

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  2. Stop watch code in verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:2.66kb
    • 提供者:Uzair
  1. Camera_driver

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  2. 摄像头OV7670与7寸液晶屏和VGA的综合实验,实现了摄像头OV7670采集,通过TFT液晶屏或者通过VGA接口连接显示器,实时显示摄像头的采集的图像。-OV7670 camera with integrated experimental 7-inch LCD screen and VGA achieve a camera OV7670 acquisition by TFT LCD screen or monitor via VGA interface, real-time display c
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-10
    • 文件大小:16.52mb
    • 提供者:刘欢
  1. ILX554B_CPLD

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  2. 用CPLD(EMP240T100C5)产生ILX554B的驱动时序,CCD的驱动时序电路程序。用verilog编写。-Drive timing generator ILX554B with CPLD (EMP240T100C5), CCD drive timing circuit program. Written in verilog.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:322.69kb
    • 提供者:刘欢
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